本文針對的采編存儲器是為了將采集到的相關(guān)飛行參數(shù)存儲起來,而且能在之后將數(shù)據(jù)讀取回來,最終能夠得到飛行數(shù)據(jù)。本文根據(jù)某任務要求,基于采編存儲器設(shè)計了自擦除模塊,當在某特殊場合時,該模塊可以可靠響應自擦除指令,并可在自帶電池可靠供電下短時間內(nèi)完成數(shù)據(jù)擦除工作。此外,在考慮了使用環(huán)境后,為了確保長線回讀數(shù)據(jù)的可靠性,還進行了數(shù)據(jù)長線傳輸設(shè)計。最后,建立了測試平臺對兩部分設(shè)計做了閉環(huán)測試,來確定設(shè)計的可靠實現(xiàn)。本文在介紹了采編存儲器自擦除模塊和長線傳輸設(shè)計的意義及相關(guān)技術(shù)的研究現(xiàn)狀。之后,根據(jù)采編存儲器相關(guān)部分的功能要求及技術(shù)指標,分別對自擦除模塊和長線傳輸模塊進行了技術(shù)需求分析,并給出了考慮的設(shè)計方案。接著對設(shè)計進行詳細的設(shè)計說明。其中,針對在自擦除指令判決時易受到干擾而出現(xiàn)的誤判現(xiàn)象,在硬件上對接收接口進行抗干擾設(shè)計;在邏輯上,基于FPGA對持續(xù)的電平型自擦除指令采用了表決邏輯進行判決,對連續(xù)脈沖的自擦除指令設(shè)計了運用容錯思想進行滑窗判決的邏輯。針對自擦除模塊供電可靠性問題,通過設(shè)計實現(xiàn)科學的電池管理,并且通過主備電源的可靠轉(zhuǎn)換,確保在設(shè)備自擦除過程中的可靠供電;針對高速數(shù)據(jù)長線傳輸?shù)恼`... 

【文章來源】：中北大學山西省

【文章頁數(shù)】：66 頁

【學位級別】：碩士

【部分圖文】：

自擦除模塊設(shè)計框圖

中北大學學位論文9圖2-2PCM數(shù)據(jù)傳輸?shù)臅r序圖FIG.2-2sequencediagramofPCMdatatransmission2.2.2長線傳輸需求分析與方案確定根據(jù)任務要求，長線傳輸模塊的實現(xiàn)可搭建如下圖2-3所示的框圖。任務要求接收兩路PCM數(shù)據(jù)后經(jīng)編幀后存儲起來，并在飛行試驗結(jié)束后可以將數(shù)據(jù)基于Hotlnk實現(xiàn)200Mbps碼率下的60m以上距離的下傳，最終將數(shù)據(jù)下載到上位機上進行處理和分析。圖2-3長線傳輸設(shè)計框圖FIG.2-3Longlinetransmissiondesignblockdiagram需要考慮以下兩方面問題：（1）存儲的數(shù)據(jù)格式要甄別數(shù)據(jù)在下載完后的內(nèi)容是否正確，需要知道存儲的數(shù)據(jù)是什么。根據(jù)要求，我們可以先存儲固定格式的數(shù)據(jù)，以便鑒別數(shù)據(jù)傳輸?shù)氖欠裾_。參照設(shè)備的要求，需要同時存儲兩路同步PCM數(shù)據(jù)，但若每路PCM單獨存在相異的FLASH中，會浪費內(nèi)部總線資源，并加大FLASH的用量。通過計算，兩路數(shù)據(jù)的最大速率約為0.86MB/s，而FLASH的寫數(shù)速率最大為35MB/s，用于信號處理的FPGA就足夠完成要求，為此擬在FPGA內(nèi)建立兩個緩存單元，每個單元放不同路的數(shù)據(jù)。當某緩存單元的數(shù)據(jù)量滿足某閾值要求時，則將對應單元的數(shù)據(jù)讀出，且添加相應的包頭、包計數(shù)、時標及校驗位來對數(shù)據(jù)進行區(qū)別。之后將打包好的數(shù)據(jù)經(jīng)內(nèi)部總線傳到存儲模

中北大學學位論文9圖2-2PCM數(shù)據(jù)傳輸?shù)臅r序圖FIG.2-2sequencediagramofPCMdatatransmission2.2.2長線傳輸需求分析與方案確定根據(jù)任務要求，長線傳輸模塊的實現(xiàn)可搭建如下圖2-3所示的框圖。任務要求接收兩路PCM數(shù)據(jù)后經(jīng)編幀后存儲起來，并在飛行試驗結(jié)束后可以將數(shù)據(jù)基于Hotlnk實現(xiàn)200Mbps碼率下的60m以上距離的下傳，最終將數(shù)據(jù)下載到上位機上進行處理和分析。圖2-3長線傳輸設(shè)計框圖FIG.2-3Longlinetransmissiondesignblockdiagram需要考慮以下兩方面問題：（1）存儲的數(shù)據(jù)格式要甄別數(shù)據(jù)在下載完后的內(nèi)容是否正確，需要知道存儲的數(shù)據(jù)是什么。根據(jù)要求，我們可以先存儲固定格式的數(shù)據(jù)，以便鑒別數(shù)據(jù)傳輸?shù)氖欠裾_。參照設(shè)備的要求，需要同時存儲兩路同步PCM數(shù)據(jù)，但若每路PCM單獨存在相異的FLASH中，會浪費內(nèi)部總線資源，并加大FLASH的用量。通過計算，兩路數(shù)據(jù)的最大速率約為0.86MB/s，而FLASH的寫數(shù)速率最大為35MB/s，用于信號處理的FPGA就足夠完成要求，為此擬在FPGA內(nèi)建立兩個緩存單元，每個單元放不同路的數(shù)據(jù)。當某緩存單元的數(shù)據(jù)量滿足某閾值要求時，則將對應單元的數(shù)據(jù)讀出，且添加相應的包頭、包計數(shù)、時標及校驗位來對數(shù)據(jù)進行區(qū)別。之后將打包好的數(shù)據(jù)經(jīng)內(nèi)部總線傳到存儲模

【參考文獻】：
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碩士論文
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[10]基于FPGA的多路脈沖信號同步測量技術(shù)研究[D]. 趙金棟.哈爾濱工業(yè)大學 2013



本文編號：3560695