發(fā)布時(shí)間：2021-12-31 17:44

　　本文針對(duì)的采編存儲(chǔ)器是為了將采集到的相關(guān)飛行參數(shù)存儲(chǔ)起來(lái),而且能在之后將數(shù)據(jù)讀取回來(lái),最終能夠得到飛行數(shù)據(jù)。本文根據(jù)某任務(wù)要求,基于采編存儲(chǔ)器設(shè)計(jì)了自擦除模塊,當(dāng)在某特殊場(chǎng)合時(shí),該模塊可以可靠響應(yīng)自擦除指令,并可在自帶電池可靠供電下短時(shí)間內(nèi)完成數(shù)據(jù)擦除工作。此外,在考慮了使用環(huán)境后,為了確保長(zhǎng)線回讀數(shù)據(jù)的可靠性,還進(jìn)行了數(shù)據(jù)長(zhǎng)線傳輸設(shè)計(jì)。最后,建立了測(cè)試平臺(tái)對(duì)兩部分設(shè)計(jì)做了閉環(huán)測(cè)試,來(lái)確定設(shè)計(jì)的可靠實(shí)現(xiàn)。本文在介紹了采編存儲(chǔ)器自擦除模塊和長(zhǎng)線傳輸設(shè)計(jì)的意義及相關(guān)技術(shù)的研究現(xiàn)狀。之后,根據(jù)采編存儲(chǔ)器相關(guān)部分的功能要求及技術(shù)指標(biāo),分別對(duì)自擦除模塊和長(zhǎng)線傳輸模塊進(jìn)行了技術(shù)需求分析,并給出了考慮的設(shè)計(jì)方案。接著對(duì)設(shè)計(jì)進(jìn)行詳細(xì)的設(shè)計(jì)說(shuō)明。其中,針對(duì)在自擦除指令判決時(shí)易受到干擾而出現(xiàn)的誤判現(xiàn)象,在硬件上對(duì)接收接口進(jìn)行抗干擾設(shè)計(jì);在邏輯上,基于FPGA對(duì)持續(xù)的電平型自擦除指令采用了表決邏輯進(jìn)行判決,對(duì)連續(xù)脈沖的自擦除指令設(shè)計(jì)了運(yùn)用容錯(cuò)思想進(jìn)行滑窗判決的邏輯。針對(duì)自擦除模塊供電可靠性問(wèn)題,通過(guò)設(shè)計(jì)實(shí)現(xiàn)科學(xué)的電池管理,并且通過(guò)主備電源的可靠轉(zhuǎn)換,確保在設(shè)備自擦除過(guò)程中的可靠供電;針對(duì)高速數(shù)據(jù)長(zhǎng)線傳輸?shù)恼`... 

【文章來(lái)源】：中北大學(xué)山西省

【文章頁(yè)數(shù)】：66 頁(yè)

【學(xué)位級(jí)別】：碩士

【部分圖文】：

自擦除模塊設(shè)計(jì)框圖

中北大學(xué)學(xué)位論文9圖2-2PCM數(shù)據(jù)傳輸?shù)臅r(shí)序圖FIG.2-2sequencediagramofPCMdatatransmission2.2.2長(zhǎng)線傳輸需求分析與方案確定根據(jù)任務(wù)要求，長(zhǎng)線傳輸模塊的實(shí)現(xiàn)可搭建如下圖2-3所示的框圖。任務(wù)要求接收兩路PCM數(shù)據(jù)后經(jīng)編幀后存儲(chǔ)起來(lái)，并在飛行試驗(yàn)結(jié)束后可以將數(shù)據(jù)基于Hotlnk實(shí)現(xiàn)200Mbps碼率下的60m以上距離的下傳，最終將數(shù)據(jù)下載到上位機(jī)上進(jìn)行處理和分析。圖2-3長(zhǎng)線傳輸設(shè)計(jì)框圖FIG.2-3Longlinetransmissiondesignblockdiagram需要考慮以下兩方面問(wèn)題：（1）存儲(chǔ)的數(shù)據(jù)格式要甄別數(shù)據(jù)在下載完后的內(nèi)容是否正確，需要知道存儲(chǔ)的數(shù)據(jù)是什么。根據(jù)要求，我們可以先存儲(chǔ)固定格式的數(shù)據(jù)，以便鑒別數(shù)據(jù)傳輸?shù)氖欠裾_。參照設(shè)備的要求，需要同時(shí)存儲(chǔ)兩路同步PCM數(shù)據(jù)，但若每路PCM單獨(dú)存在相異的FLASH中，會(huì)浪費(fèi)內(nèi)部總線資源，并加大FLASH的用量。通過(guò)計(jì)算，兩路數(shù)據(jù)的最大速率約為0.86MB/s，而FLASH的寫數(shù)速率最大為35MB/s，用于信號(hào)處理的FPGA就足夠完成要求，為此擬在FPGA內(nèi)建立兩個(gè)緩存單元，每個(gè)單元放不同路的數(shù)據(jù)。當(dāng)某緩存單元的數(shù)據(jù)量滿足某閾值要求時(shí)，則將對(duì)應(yīng)單元的數(shù)據(jù)讀出，且添加相應(yīng)的包頭、包計(jì)數(shù)、時(shí)標(biāo)及校驗(yàn)位來(lái)對(duì)數(shù)據(jù)進(jìn)行區(qū)別。之后將打包好的數(shù)據(jù)經(jīng)內(nèi)部總線傳到存儲(chǔ)模

中北大學(xué)學(xué)位論文9圖2-2PCM數(shù)據(jù)傳輸?shù)臅r(shí)序圖FIG.2-2sequencediagramofPCMdatatransmission2.2.2長(zhǎng)線傳輸需求分析與方案確定根據(jù)任務(wù)要求，長(zhǎng)線傳輸模塊的實(shí)現(xiàn)可搭建如下圖2-3所示的框圖。任務(wù)要求接收兩路PCM數(shù)據(jù)后經(jīng)編幀后存儲(chǔ)起來(lái)，并在飛行試驗(yàn)結(jié)束后可以將數(shù)據(jù)基于Hotlnk實(shí)現(xiàn)200Mbps碼率下的60m以上距離的下傳，最終將數(shù)據(jù)下載到上位機(jī)上進(jìn)行處理和分析。圖2-3長(zhǎng)線傳輸設(shè)計(jì)框圖FIG.2-3Longlinetransmissiondesignblockdiagram需要考慮以下兩方面問(wèn)題：（1）存儲(chǔ)的數(shù)據(jù)格式要甄別數(shù)據(jù)在下載完后的內(nèi)容是否正確，需要知道存儲(chǔ)的數(shù)據(jù)是什么。根據(jù)要求，我們可以先存儲(chǔ)固定格式的數(shù)據(jù)，以便鑒別數(shù)據(jù)傳輸?shù)氖欠裾_。參照設(shè)備的要求，需要同時(shí)存儲(chǔ)兩路同步PCM數(shù)據(jù)，但若每路PCM單獨(dú)存在相異的FLASH中，會(huì)浪費(fèi)內(nèi)部總線資源，并加大FLASH的用量。通過(guò)計(jì)算，兩路數(shù)據(jù)的最大速率約為0.86MB/s，而FLASH的寫數(shù)速率最大為35MB/s，用于信號(hào)處理的FPGA就足夠完成要求，為此擬在FPGA內(nèi)建立兩個(gè)緩存單元，每個(gè)單元放不同路的數(shù)據(jù)。當(dāng)某緩存單元的數(shù)據(jù)量滿足某閾值要求時(shí)，則將對(duì)應(yīng)單元的數(shù)據(jù)讀出，且添加相應(yīng)的包頭、包計(jì)數(shù)、時(shí)標(biāo)及校驗(yàn)位來(lái)對(duì)數(shù)據(jù)進(jìn)行區(qū)別。之后將打包好的數(shù)據(jù)經(jīng)內(nèi)部總線傳到存儲(chǔ)模

【參考文獻(xiàn)】：
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碩士論文
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