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JESD204B高速串行接口的模塊設(shè)計(jì)

發(fā)布時(shí)間:2021-01-28 22:11
  數(shù)據(jù)轉(zhuǎn)換器是溝通數(shù)字世界和模擬世界的橋梁,是生活中普遍存在的重要基礎(chǔ)技術(shù)。隨著數(shù)據(jù)業(yè)務(wù)需求的激增,數(shù)據(jù)轉(zhuǎn)換器的性能不斷提升,朝著更高分辨率,更快采樣速率的方向發(fā)展,同時(shí)還要面對(duì)低功耗、器件小型化、多通道集成等挑戰(zhàn)。這些挑戰(zhàn)加劇了數(shù)據(jù)轉(zhuǎn)換器與邏輯器件之間的數(shù)據(jù)傳輸問(wèn)題,傳統(tǒng)的并行傳輸方式易受碼間串?dāng)_影響,布線要求苛刻,已不能完成大數(shù)據(jù)量的同步傳輸需求。因此需要一種同步機(jī)制完善,以串行方式傳輸數(shù)據(jù)的接口。固態(tài)技術(shù)協(xié)會(huì)JEDEC發(fā)布的高速串行接口標(biāo)準(zhǔn)——JESD204,解決了高分辨率、高采樣率、多通道轉(zhuǎn)換器的數(shù)據(jù)傳輸問(wèn)題。JESD204接口相比于傳統(tǒng)的并行接口,在引腳數(shù)量,功耗和封裝尺寸的等方面具有顯著的優(yōu)勢(shì),且自JESD204B版本起引入確定性延遲這一重要概念,使數(shù)據(jù)轉(zhuǎn)換器和邏輯器件間的數(shù)據(jù)傳輸有了完善的同步機(jī)制。本文在深入理解JESD204B標(biāo)準(zhǔn)的基礎(chǔ)上,使用Veriolg硬件描述語(yǔ)言設(shè)計(jì)了符合標(biāo)準(zhǔn)的發(fā)送端電路模塊。該模塊支持片內(nèi)集成的應(yīng)用,可滿足雙通道、12位分辨率、1.6Gsps采樣率的ADC在四種采樣模式下的數(shù)據(jù)采樣,并可適配于符合LV-OIF-11G-SR規(guī)范的物理層。最終數(shù)據(jù)串... 

【文章來(lái)源】:西安電子科技大學(xué)陜西省 211工程院校 教育部直屬院校

【文章頁(yè)數(shù)】:100 頁(yè)

【學(xué)位級(jí)別】:碩士

【部分圖文】:

JESD204B高速串行接口的模塊設(shè)計(jì)


JESD204標(biāo)準(zhǔn)簡(jiǎn)圖

JESD204B高速串行接口的模塊設(shè)計(jì)


JESD204A標(biāo)準(zhǔn)簡(jiǎn)圖

JESD204B高速串行接口的模塊設(shè)計(jì)


JESD204B標(biāo)準(zhǔn)簡(jiǎn)圖

【參考文獻(xiàn)】:
期刊論文
[1]基于JESD204B的高速串行數(shù)據(jù)收發(fā)接口設(shè)計(jì)[J]. 徐鳳萍,龔至誠(chéng),王巍.  指揮控制與仿真. 2018(05)
[2]采用并行8b/10b編碼的JESD204B接口發(fā)送端電路設(shè)計(jì)[J]. 李長(zhǎng)慶,程軍,李梁,龔燎.  微電子學(xué)與計(jì)算機(jī). 2017(08)
[3]JESD204B協(xié)議中發(fā)送端同步電路設(shè)計(jì)與實(shí)現(xiàn)[J]. 歐陽(yáng)靖,姚亞峰,霍興華,譚宇.  電子器件. 2017(01)
[4]JESD204B接口中8B10B解碼電路quadbyte設(shè)計(jì)[J]. 霍興華,姚亞峰,陳朝.  電子技術(shù). 2016(08)
[5]JESD204B接口協(xié)議中的8B10B編碼器設(shè)計(jì)[J]. 霍興華,姚亞峰,賈茜茜,劉建.  電子器件. 2015(05)
[6]JESD204B子類:簡(jiǎn)介和確定性延遲[J]. Del Jones.  中國(guó)電子商情(基礎(chǔ)電子). 2015(03)
[7]JESD204B接口協(xié)議中的加擾電路設(shè)計(jì)[J]. 霍興華,姚亞峰,賈茜茜,陳登.  電視技術(shù). 2014(23)
[8]JESD204B接口協(xié)議中的8B/10B解碼器設(shè)計(jì)[J]. 陳登,姚亞峰,歐陽(yáng)靖,霍興華.  電視技術(shù). 2014(19)
[9]JESD204標(biāo)準(zhǔn)解析[J]. Jonathan Harris.  今日電子. 2012(12)
[10]CMOS集成電路及其具體應(yīng)用[J]. 薛寶富,王海富.  黑龍江科技信息. 2011(28)

碩士論文
[1]8b/10b編解碼器及Rapid IO 2.0差分接收機(jī)的設(shè)計(jì)[D]. 蘇鵬洲.中國(guó)科學(xué)技術(shù)大學(xué) 2015
[2]基于8b/10b編碼技術(shù)的SerDes接口電路設(shè)計(jì)[D]. 李永乾.電子科技大學(xué) 2010
[3]光纖通道8B/10B編碼的CPLD實(shí)現(xiàn)與驗(yàn)證[D]. 陳孟杰.西北工業(yè)大學(xué) 2007



本文編號(hào):3005781

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