單核處理器片上滲透數(shù)據(jù)調(diào)配實(shí)現(xiàn)機(jī)制研究
【學(xué)位單位】:北京交通大學(xué)
【學(xué)位級別】:碩士
【學(xué)位年份】:2019
【中圖分類】:TP332
【文章目錄】:
致謝
摘要
ABSTRACT
1 引言
1.1 背景和意義
1.2 國內(nèi)外研究現(xiàn)狀
1.3 本文研究內(nèi)容
1.4 論文結(jié)構(gòu)
1.5 本章小結(jié)
2 滲透數(shù)據(jù)調(diào)配實(shí)現(xiàn)機(jī)制研究
2.1 及時局部性和滲透數(shù)據(jù)分析
2.2 滲透思想分析
2.3 滲透寄存器研究
2.3.1 滲透寄存器結(jié)構(gòu)
2.3.2 擴(kuò)展的片上存儲層次
2.3.3 滲透數(shù)據(jù)在新存儲層次中的調(diào)配方法
2.4 滲透流水線研究
2.4.1 滲透流水線與主流水線的協(xié)同工作
2.4.2 指令相關(guān)和流水線沖突
2.4.3 滲透流水線執(zhí)行階段
2.5 滲透流水線和滲透寄存器優(yōu)點(diǎn)
2.6 本章小結(jié)
3 滲透數(shù)據(jù)調(diào)配仿真工具設(shè)計
3.1 設(shè)計方案
3.1.1 需求分析
3.1.2 滲透流水線仿真工具總體設(shè)計
3.1.3 傳統(tǒng)流水線仿真工具總體設(shè)計
3.2 指令集設(shè)計
3.3 功能模塊設(shè)計
3.3.1 驅(qū)動模塊設(shè)計
3.3.2 時鐘分頻模塊設(shè)計
3.3.3 處理器控制模塊設(shè)計
3.3.4 處理器模塊設(shè)計
3.3.5 指令存儲器模塊設(shè)計
3.3.6 滲透寄存器模塊設(shè)計
3.3.7 緩存模塊設(shè)計
3.3.8 內(nèi)存模塊設(shè)計
3.3.9 頂層模塊設(shè)計
3.4 本章小結(jié)
4 滲透數(shù)據(jù)調(diào)配仿真實(shí)驗(yàn)
4.1 流水線有效性評估
4.2 測試指令
4.3 實(shí)驗(yàn)一:傳統(tǒng)流水線功能驗(yàn)證
4.4 實(shí)驗(yàn)二:滲透流水線可行性證明
4.4.1 滲透流水線階段證明
4.4.2 滲透流水線執(zhí)行過程證明
4.5 實(shí)驗(yàn)總結(jié)
4.6 本章小結(jié)
5 結(jié)論
5.1 總結(jié)
5.2 展望
參考文獻(xiàn)
作者簡歷及攻讀碩士學(xué)位期間取得的研究成果
學(xué)位論文數(shù)據(jù)集
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本文編號:2893209
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