【摘要】： 論文簡(jiǎn)要概述PCI系列總線的發(fā)展歷程，PCI Express總線的優(yōu)勢(shì)，介紹PCI-SIG的PCI Express 1．1規(guī)范，詳細(xì)討論P(yáng)CI Express物理層(Physical Layer)電路設(shè)計(jì)。其設(shè)計(jì)內(nèi)容主要包括8B／10B編解碼器，串行／解串器，發(fā)送端驅(qū)動(dòng)，接收器，接收端檢測(cè)以及信標(biāo)。 8B／10B編碼部分研究8B／10B編碼的內(nèi)在相關(guān)性，采用一種基于邏輯設(shè)計(jì)的編解碼方法，以達(dá)到簡(jiǎn)化實(shí)現(xiàn)結(jié)構(gòu)，用于大規(guī)模集成電路設(shè)計(jì)的目的。 串行／解串器部分首先介紹其工作原理，詳細(xì)討論高速數(shù)據(jù)率下可能遇到的困難和解決方法，并給出串行／解串器具體的核心電路。 發(fā)送端驅(qū)動(dòng)部分的設(shè)計(jì)主要包括：前置驅(qū)動(dòng)電路，預(yù)加重電路和主驅(qū)動(dòng)電路。 接收器部分的設(shè)計(jì)主要包括：電壓轉(zhuǎn)換級(jí)，數(shù)據(jù)采樣級(jí)和數(shù)據(jù)保持級(jí)。在數(shù)據(jù)采樣級(jí)中采用過(guò)采樣技來(lái)來(lái)消除亞穩(wěn)態(tài)(Metastable)問(wèn)題，并采用了數(shù)字移位器來(lái)減小誤碼率。 電路設(shè)計(jì)基于SMIC的0.18um CMOS混合信號(hào)模型，仿真結(jié)果表明，所設(shè)計(jì)的物理層電路在2.4Gbps的信號(hào)傳輸速率下，所有性能達(dá)到PCI-SIG的PCI Expressl.1規(guī)范要求。
【學(xué)位授予單位】：西安電子科技大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2006
【分類號(hào)】：TP336
【圖文】：

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第二章 PclExPress物理層系統(tǒng)設(shè)計(jì)構(gòu)不完全相同，如圖2.3(a)圖所示的是桌面機(jī)和移動(dòng)筆記本電腦中使用 PCIExPress總線的系統(tǒng)架構(gòu)，而圖2.3(b)圖所示的是服務(wù)器和工作站中使用 PCIExPress總線的系統(tǒng)架構(gòu)。除此之外，在網(wǎng)絡(luò)中同樣可以以使用 PCIExPress總線技術(shù)進(jìn)行通信，結(jié)構(gòu)圖如圖2.4所示。 CCCPUUU MMMemoryyyyyyyyyyyyy BBBridgeeeeeMemoryyy lllllllllllllllllllll!OOO誰(shuí) 誰(shuí)誰(shuí) 誰(shuí)Bdd口 eee...琦， lllllllllllll腸 腸翻.二一 fffPPPC毛ExPre‘ sss(a)(b)圖2‘3服務(wù)器和工作站中使用 PCIExPress總線的系統(tǒng)架構(gòu)從圖2.3中的兩個(gè)應(yīng)用架構(gòu)比較可以看出， PCIExpress總線技術(shù)在服務(wù)器和工作站中的應(yīng)用更為徹底，在服務(wù)器/工作站中除了內(nèi)存子系統(tǒng)與芯片組之間的通信外，其它都是采用 PCIExPress總線來(lái)與芯片連接的

【參考文獻(xiàn)】

相關(guān)期刊論文 前3條

1 趙文虎,王志功,費(fèi)瑞霞,朱恩,吳微;基于邏輯設(shè)計(jì)的光纖通信8B/10B編解碼方法研究[J];電路與系統(tǒng)學(xué)報(bào);2003年02期

2 熊軍,何樂(lè)年,嚴(yán)曉浪;一種新型的用于高速串行接口的發(fā)送器[J];電路與系統(tǒng)學(xué)報(bào);2004年05期

3 李浩亮,何樂(lè)年,嚴(yán)曉浪;一種新型的用于高速串行接口電路中的接收器[J];電路與系統(tǒng)學(xué)報(bào);2004年05期

本文編號(hào)：2751128