【摘要】：片上多處理器系統(tǒng)的發(fā)展導(dǎo)致片上高速緩存的所占面積急劇增加,其對應(yīng)的泄露功耗也相應(yīng)增加。將高速緩存行劃分成3部分進(jìn)行控制,其中數(shù)據(jù)部分的訪問分為協(xié)議訪問和數(shù)據(jù)訪問兩部分,每部分支持多種工作模式來進(jìn)行管控。通過工作模式的切換對高速緩存的三部分進(jìn)行管控可以使漏過功耗平均減少76.78%,但相應(yīng)的性能損失最高會達(dá)到7.74%。由于性能損失較大,提出了一種改進(jìn)的高速緩存衰退的方法來優(yōu)化管控策略。這種策略不僅能夠把性能損失控制在3%以下,而且能夠保證平均能耗優(yōu)化達(dá)到近75%。
[Abstract]:The development of on-chip multiprocessor system leads to a sharp increase in the area of on-chip cache, and the corresponding leakage power consumption increases accordingly. The high speed cache line is divided into three parts to control, in which the access to the data part is divided into two parts: protocol access and data access, each part of which supports a variety of working modes to control. By switching the working mode to control the three parts of the cache, the average leakage power consumption can be reduced by 76.78%, but the corresponding performance loss will reach 7.74%. Because of the large performance loss, an improved cache decay method is proposed to optimize the management and control strategy. This strategy can not only control the performance loss below 3%, but also ensure the optimization of average energy consumption to nearly 75%.
【作者單位】： 電子科技大學(xué)通信與信息工程學(xué)院;
【分類號】：TP332

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本文編號：2481560