【摘要】：為探索通用可重構(gòu)處理器(general-purpose reconfigurable processor,GReP)在序列密碼算法中的研究與應(yīng)用,本文對基于反饋移位寄存器(feedback shift register,FSR)的序列密碼算法進(jìn)行特征分析,結(jié)合GReP架構(gòu)特性,提出掩碼抽位式反饋函數(shù)計(jì)算模型,以A5算法為例,對算法中對性能影響大、復(fù)用性高且具有可重構(gòu)性的關(guān)鍵部件提出并行化、流水化的優(yōu)化設(shè)計(jì)方法,實(shí)現(xiàn)了算法的基于GReP的可重構(gòu)優(yōu)化.實(shí)驗(yàn)表明,基于GReP通用可重構(gòu)處理器架構(gòu)的A5算法可重構(gòu)設(shè)計(jì),比在Intel Atom 230平臺(tái)上的吞吐率提高近一倍,GReP通用可重構(gòu)處理器在提高序列密碼算法處理能力與執(zhí)行效率方面具有明顯優(yōu)勢.
[Abstract]:In order to explore the research and application of general reconfigurable processor (general-purpose reconfigurable processor,GReP) in sequential cipher algorithm, this paper analyzes the characteristic of sequence cipher algorithm based on feedback shift register (feedback shift register,FSR), and combines the characteristics of GReP architecture. A calculation model of masked pumping feedback function is proposed. Taking A5 algorithm as an example, an optimization design method of parallelization and pipelining is proposed for key components with high performance, high reusability and reconfiguration. Reconfigurable optimization based on GReP is realized. Experiments show that the reconfigurable design of A5 algorithm based on GReP general reconfigurable processor architecture is nearly twice as high as that on Intel Atom 230 platform. The GReP general reconfigurable processor has obvious advantages in improving the processing ability and execution efficiency of sequential cryptographic algorithms.
【作者單位】： 解放軍信息工程大學(xué)四院;解放軍信息工程大學(xué)數(shù)學(xué)工程與先進(jìn)計(jì)算國家重點(diǎn)實(shí)驗(yàn)室;
【基金】：國家高技術(shù)研究發(fā)展(863)計(jì)劃資助項(xiàng)目(2012AA012704)
【分類號】：TP332

【參考文獻(xiàn)】

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【共引文獻(xiàn)】

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【二級參考文獻(xiàn)】

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【相似文獻(xiàn)】

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本文編號：2372028