【摘要】：設計了一款符合EPC C1 G2/ISO 18000-6C協(xié)議的超高頻射頻識別標簽數(shù)字基帶處理器。采用新型數(shù)字基帶結構,并運用門控時鐘、異步計數(shù)器和多種低頻時鐘協(xié)同工作等多種低功耗設計方法,降低了標簽芯片的功耗和面積。在TSMC 0.18μm標準CMOS工藝下流片,數(shù)字基帶處理器版圖面積為0.14mm2,數(shù)字部分平均功耗為14μW。
[Abstract]:A digital baseband processor for EPC C1 G2/ISO 18000-6C is designed. A new digital baseband structure is adopted and a variety of low-power design methods such as gated clock asynchronous counter and various low-frequency clocks are used to reduce the power consumption and area of the tag chip. Under the TSMC 0.18 渭 m standard CMOS process, the digital baseband processor has a layout area of 0.14 mm 2, and the average power consumption of the digital part is 14 渭 W.
【作者單位】： 北京工業(yè)大學北京市嵌入式重點實驗室;斯凱瑞利(北京)科技有限公司;
【基金】：北京市科委科技計劃項目(E141100006014032)
【分類號】：TP332;TP391.44

【參考文獻】

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