【摘要】：隨著圖形處理性能的不斷提升,圖形處理的運(yùn)算量也日益增多,傳統(tǒng)的嵌入式系統(tǒng)面臨著挑戰(zhàn)。解決這一問題的方案之一是運(yùn)用可編程器件開發(fā)適用于嵌入式系統(tǒng)的圖形處理器,從而提高處理速度�，F(xiàn)代圖形處理器采用各種可編程的著色處理器,雖然ASIC的速度和功耗性能優(yōu)于可編程處理器,但其靈活性與可靠性卻是無法與可編程處理器比擬的。采用一種帶精簡(jiǎn)指令的微控制器架構(gòu),重點(diǎn)研究用匯編和可編程處理器協(xié)同實(shí)現(xiàn)平面剪裁功能,代替原來用純硬件實(shí)現(xiàn)的功能,該流水線執(zhí)行多指令多數(shù)據(jù)流(MIMD)。最后,使用大量的測(cè)試用例對(duì)點(diǎn)、線和三角形在FPGA開發(fā)板上進(jìn)行相應(yīng)的驗(yàn)證。
[Abstract]:With the improvement of graphics processing performance, the computation of graphics processing is increasing day by day, and traditional embedded systems are facing challenges. One of the solutions to this problem is to use programmable devices to develop graphics processors suitable for embedded systems, so as to improve the processing speed. Modern graphics processors use various programmable coloring processors. Although the speed and power performance of ASIC is better than that of programmable processors, its flexibility and reliability are not comparable to those of programmable processors. In this paper, a microcontroller architecture with reduced instructions is adopted. The emphasis is on the collaborative implementation of plane clipping with assembler and programmable processor, instead of the original function implemented with pure hardware. The pipeline executes multi-instruction and multi-data flow (MIMD). Finally, a large number of test cases are used to verify the points, lines and triangles on the FPGA development board.
【作者單位】： 西安郵電大學(xué)電子工程學(xué)院;西安郵電大學(xué)計(jì)算機(jī)學(xué)院;
【基金】：國(guó)家自然科學(xué)基金重點(diǎn)資助項(xiàng)目(61136002)
【分類號(hào)】：TP332

【參考文獻(xiàn)】

相關(guān)期刊論文 前1條

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【共引文獻(xiàn)】

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【二級(jí)參考文獻(xiàn)】

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【相似文獻(xiàn)】

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本文編號(hào)：2211508