本文選題：FLASH存儲(chǔ)控制器 + 大容量FLASH�。� 參考：《光學(xué)精密工程》2015年04期

【摘要】：為克服傳統(tǒng)大容量FLASH視頻存儲(chǔ)控制器時(shí)序設(shè)計(jì)復(fù)雜、緩存資源要求較高的缺點(diǎn),設(shè)計(jì)了一種利用視頻行場(chǎng)信號(hào)消隱期進(jìn)行時(shí)序控制的FLASH視頻存儲(chǔ)控制器。該控制器基于FPGA時(shí)序設(shè)計(jì),利用視頻行場(chǎng)同步信號(hào)消隱期時(shí)間寫入FLASH的讀出和寫入控制命令。由于無需緩存資源即可實(shí)現(xiàn)多級(jí)流水線的設(shè)計(jì),提高了時(shí)序控制效率,簡(jiǎn)化了時(shí)序設(shè)計(jì)過程�；赩erilog硬件描述語(yǔ)言,設(shè)計(jì)了3級(jí)流水線和并行控制時(shí)序,數(shù)據(jù)達(dá)120 MB/s,實(shí)現(xiàn)了對(duì)2 048pixel×1 752pixel/15frames高速視頻數(shù)據(jù)的實(shí)時(shí)存儲(chǔ)與回放。仿真與實(shí)驗(yàn)結(jié)果均表明,系統(tǒng)時(shí)序設(shè)計(jì)正確,大容量FLASH陣列讀寫操作正常,可實(shí)現(xiàn)視頻數(shù)據(jù)的采集、存儲(chǔ)、回放等多種功能。
[Abstract]:In order to overcome the shortcomings of complex timing design and high buffer resource requirement of the traditional flash video memory controller, a flash video storage controller is designed, which uses the hidden period of the video row field signal to control the timing of the flash video storage controller. The controller is based on FPGA timing design and writes the read and write control commands of flash using the blanking time of the video row field synchronization signal. Because the multilevel pipeline design can be realized without buffer resource, the efficiency of timing control is improved and the process of timing design is simplified. Based on Verilog hardware description language, a 3-level pipeline and parallel control sequence is designed. The data is up to 120MB / s, and the real-time storage and playback of 2 048pixel 脳 1 752pixel/15frames video data is realized. The simulation and experimental results show that the timing design of the system is correct and the reading and writing operation of large flash array is normal. It can realize many functions such as video data acquisition, storage, playback and so on.
【作者單位】： 北京環(huán)境特性研究所光學(xué)輻射重點(diǎn)實(shí)驗(yàn)室;
【基金】：航天創(chuàng)新基金資助項(xiàng)目(No.K3010199S142)
【分類號(hào)】：TP333

【參考文獻(xiàn)】

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【共引文獻(xiàn)】

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【二級(jí)參考文獻(xiàn)】

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本文編號(hào)：2060684