本文選題：陣列處理器 + 可重構(gòu)技術(shù)��； 參考：《西安郵電大學(xué)學(xué)報(bào)》2016年03期

【摘要】：基于可重構(gòu)技術(shù)以及SystemC的體系結(jié)構(gòu)建模特點(diǎn),構(gòu)建一種基于SystemC的可重構(gòu)陣列處理器模型。采用模塊化的SystemC系統(tǒng)模型分別對指令傳輸模塊、處理元模塊以及鄰接互連模塊建模,構(gòu)成32×32的可重構(gòu)陣列處理器。通過指令傳輸模塊實(shí)現(xiàn)局部和非局部兩種單指令多數(shù)據(jù)模式的快速切換,使用鄰接互連模塊完成處理元間的通信。對建立的模型進(jìn)行仿真驗(yàn)證,同時(shí)將高效視頻編解碼標(biāo)準(zhǔn)中視頻算法映射到該模型上。仿真結(jié)果表明,該模型搭建正確,能夠?qū)崿F(xiàn)視頻編解碼標(biāo)準(zhǔn)中視頻算法的并行化映射。
[Abstract]:Based on the reconfigurable technology and the characteristics of SystemC architecture modeling, a reconfigurable array processor model based on SystemC is constructed. The modular SystemC system model is used to model the instruction transmission module, the processing meta-module and the adjacent interconnection module, respectively, and a 32 脳 32 reconfigurable array processor is constructed. The fast switching of local and non-local single instruction multi-data modes is realized by the instruction transmission module, and the communication between processing elements is accomplished by the adjacent interconnection module. At the same time, the video algorithm in the efficient video coding and decoding standard is mapped to the model. The simulation results show that the model is correct and can realize the parallel mapping of video algorithms in video coding and decoding standards.
【作者單位】： 西安郵電大學(xué)電子工程學(xué)院;
【基金】：國家自然科學(xué)基金資助項(xiàng)目(61272120) 陜西省自然科學(xué)基金資助項(xiàng)目(2015JM6326) 陜西省科技統(tǒng)籌創(chuàng)新工程基金資助項(xiàng)目(2016KTZDGY02-04-02)
【分類號】：TP332

【參考文獻(xiàn)】

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【共引文獻(xiàn)】

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【二級參考文獻(xiàn)】

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本文編號：1873743