多核處理器中改進的動態(tài)緩存優(yōu)化技術(shù)
本文選題:緩存資源池 切入點:緩存共享 出處:《計算機工程》2015年08期
【摘要】:為提高多核處理器中緩存資源池效率并降低芯片總面積,設(shè)計三維多核結(jié)構(gòu),同時給出在線應(yīng)用感知作業(yè)分配和緩存共享策略。通過分析應(yīng)用程序性能特征預(yù)測資源需求量,將相鄰層中具有不同緩存特點的作業(yè)分配給三維多核結(jié)構(gòu)內(nèi)核,使應(yīng)用程序與緩存用途相匹配,同時根據(jù)應(yīng)用程序?qū)彺嫘枨蠖确峙渚彺尜Y源,實現(xiàn)緩存資源利用率的最大化。實驗結(jié)果表明,該策略可提高系統(tǒng)性能,降低能耗和芯片面積,與基于靜態(tài)緩存的三維多核存儲器相比,該三維多核結(jié)構(gòu)的能量延遲乘積和能量延遲面積乘積分別提高了36.9%和57.2%。
[Abstract]:In order to improve the efficiency of cache resource pool and reduce the total chip area in multi-core processor, a three-dimensional multi-core structure is designed, and an online application aware job allocation and buffer sharing strategy is proposed.By analyzing the performance characteristics of applications to predict resource requirements, jobs with different cache characteristics in adjacent layers are assigned to the kernel of 3D multicore structure, so that the application can match the purpose of cache.At the same time, the cache resources are allocated according to the application requirements to maximize the utilization of cache resources.Experimental results show that this strategy can improve system performance, reduce energy consumption and chip area. Compared with the static buffer based 3D multi-core memory, the energy delay product and energy delay area product of the 3D multi-core structure are increased by 36.9% and 57.2%, respectively.
【作者單位】: 黃淮學院信息工程學院;
【基金】:河南省科技攻關(guān)計劃基金資助項目(122102210430) 河南省教育廳科學技術(shù)研究基金資助重點項目(14B520036)
【分類號】:TP332
【參考文獻】
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【共引文獻】
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【二級參考文獻】
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,本文編號:1722846
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