本文選題：HDMI　切入點(diǎn)：音頻時(shí)鐘恢復(fù)　出處：《沈陽(yáng)工業(yè)大學(xué)》2017年碩士論文

【摘要】：隨著數(shù)字技術(shù)的高速發(fā)展,在高速傳輸、大數(shù)據(jù)量的技術(shù)需求下,高清晰多媒體傳輸技術(shù)成為當(dāng)下消費(fèi)電子行業(yè)研發(fā)的重點(diǎn)。各種各樣的數(shù)字傳輸接口開(kāi)始出現(xiàn)在人們的日常生活中。HDMI(High Definition Multimedia Interface)高清晰度多媒體接口成為現(xiàn)代數(shù)字接口傳輸高清視頻的主要代表之一。論文以HDMI協(xié)議為基礎(chǔ),研究HDMI協(xié)議范圍內(nèi)的音頻時(shí)鐘恢復(fù)的問(wèn)題。HDMI的音頻時(shí)鐘恢復(fù)包含參數(shù)N、CTS的傳輸和頻率合成兩方面的內(nèi)容。在參數(shù)N和CTS的傳輸上,對(duì)比了HDMI 1.4b版和HDMI 2.0版兩種典型協(xié)議下的數(shù)據(jù)傳輸模式。在數(shù)據(jù)傳輸通路設(shè)計(jì)中加入了數(shù)據(jù)加擾的過(guò)程,同時(shí)保證了HDMI接口的向下兼容性。HDMI的發(fā)送端包含參數(shù)CTS的提取,參數(shù)N和CTS的打包,視頻數(shù)據(jù)的處理,數(shù)據(jù)加擾和數(shù)據(jù)編碼等。HDMI的接收端包含數(shù)據(jù)同步處理,數(shù)據(jù)解碼,數(shù)據(jù)解擾,視頻數(shù)據(jù)處理,數(shù)據(jù)包提取,數(shù)據(jù)包解包等。在頻率合成方面,HDMI系統(tǒng)采用了PLL激勵(lì)DDS的混合頻率合成方式。PLL輸出固定的高頻信號(hào),DDS對(duì)高頻信號(hào)分頻,依據(jù)不同的控制信號(hào)得到不同的分頻時(shí)鐘。文中采用了多相位時(shí)鐘輸入的DDS結(jié)構(gòu),推導(dǎo)了DDS輸出頻率和PLL輸出頻率的關(guān)系。根據(jù)上述關(guān)系,確定了HDMI接收端在音頻時(shí)鐘再生包中提取的參數(shù)N,CTS和DDS控制信號(hào)的映射關(guān)系,進(jìn)而控制DDS模塊的頻率輸出,完成音頻時(shí)鐘恢復(fù)。數(shù)據(jù)傳輸通路采用Verilog HDL設(shè)計(jì),通過(guò)NC-Verilog進(jìn)行驗(yàn)證;DDS設(shè)計(jì)中包含數(shù)字部分和模擬部分,采用混合驗(yàn)證的方式。仿真結(jié)果表明數(shù)據(jù)傳輸通路能正確傳輸數(shù)據(jù),DDS可以恢復(fù)出音頻時(shí)鐘。
[Abstract]:With the rapid development of digital technology, high definition multimedia transmission technology has become the focus of consumer electronics research and development under the demand of high-speed transmission and large amount of data.HDMI High Definition Multimedia Interface (HDMI) has become one of the main representatives of modern digital interfaces for the transmission of high definition video.Based on the HDMI protocol, this paper studies the problem of audio clock recovery in the range of HDMI protocol. The audio clock recovery of HDMI includes the transmission and frequency synthesis of the parameter NCT-CTS.In the transmission of parameter N and CTS, the data transfer modes under HDMI version 1.4b and HDMI version 2.0 are compared.Data scrambling and data coding. HDMI receiver includes data synchronization, data decoding, data descrambling, video data processing, packet extraction, packet unpacking, etc.In the aspect of frequency synthesis, the mixed frequency synthesis mode of PLL excited DDS. PLL outputs fixed high frequency signal to divide the frequency of high frequency signal. According to the different control signal, different frequency division clock is obtained.In this paper, the DDS structure of multi-phase clock input is adopted, and the relation between DDS output frequency and PLL output frequency is deduced.According to the above relation, the mapping relationship between the parameters of the HDMI receiver extracted from the audio clock regeneration packet and the DDS control signal is determined, and then the frequency output of the DDS module is controlled to complete the audio clock recovery.The data transmission path is designed by Verilog HDL. The design of NC-Verilog includes digital part and analog part.The simulation results show that the data transmission path can transmit the data correctly and the DDS can recover the audio clock.
【學(xué)位授予單位】：沈陽(yáng)工業(yè)大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2017
【分類號(hào)】：TP334.7;TN741

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本文編號(hào)：1700197