本文選題：驗證　切入點：數字信號處理器　出處：《計算機工程》2015年09期

【摘要】：針對數字信號處理器設計中因相關引發(fā)的故障,提出一種基于指令的驗證方法。結合處理器的體系結構特點給出處理器表示矩陣,并利用該矩陣,根據所使用的功能單元對指令進行劃分。在同一個劃分內,指令使用相同的功能單元,對這些指令進行兩兩組合,生成驗證指令序列�？紤]測試的可觀測性給出觀測方法,從理論上證明該方法可以完備覆蓋到所有數據相關故障。設計驗證指令生成系統(tǒng)自動生成驗證指令序列,針對DSPC-01處理器進行實驗,并與流片后的測試結果比較分析,結果驗證了該方法的有效性。
[Abstract]:This paper presents an instruction based verification method for the faults caused by correlation in the design of the digital signal processor, and gives the processor representation matrix according to the architecture characteristics of the processor, and makes use of the matrix. In the same partition, the instruction uses the same functional unit to combine these instructions in pairs to generate the sequence of verification instructions. Considering the observability of the test, the method of observation is given. It is proved in theory that this method can cover all data related faults completely. The design verification instruction generation system automatically generates the verification instruction sequence, carries out the experiment against the DSPC-01 processor, and compares the test results with the test results after the flow sheet. The results show that the method is effective.
【作者單位】： 北京電子工程總體研究所;
【分類號】：TP332

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本文編號：1655308