本文選題：處理器陣列　切入點(diǎn)：重構(gòu)　出處：《小型微型計(jì)算機(jī)系統(tǒng)》2015年02期 　論文類型：期刊論文

【摘要】：網(wǎng)格連接的處理器陣列是一種應(yīng)用廣泛的高性能體系結(jié)構(gòu),而容錯(cuò)處理器陣列的重構(gòu)技術(shù)是近年來(lái)的研究熱點(diǎn)之一.現(xiàn)有的研究多數(shù)集中在串行重構(gòu)算法上,忽視了該結(jié)構(gòu)重構(gòu)時(shí)內(nèi)在的可并行性.本文根據(jù)陣列結(jié)構(gòu)的特點(diǎn)設(shè)計(jì)了一種基于VHDL語(yǔ)言的重構(gòu)算法,該算法從第一行的各個(gè)無(wú)故障處理器單元同時(shí)向下選路,具有潛在的并行性,.實(shí)驗(yàn)結(jié)果表明,與現(xiàn)有的串行算法相比,本文提出的并行算法同樣能夠生成最大規(guī)模的目標(biāo)陣列并且當(dāng)物理陣列大小為48×48,本文提出的并行算法加速重構(gòu)將近20倍.
[Abstract]:Grid connected processor array is a widely used high-performance architecture, and the reconstruction technology of fault-tolerant processor array is one of the research hotspots in recent years. In this paper, we design a reconstruction algorithm based on VHDL language according to the characteristics of the array structure. The algorithm selects the path from each fault-free processor unit in the first line at the same time. The experimental results show that, compared with the existing serial algorithms, The parallel algorithm proposed in this paper can also generate the largest target array. When the physical array size is 48 脳 48, the parallel algorithm proposed in this paper accelerates reconstruction by nearly 20 times.
【作者單位】： 天津工業(yè)大學(xué)計(jì)算機(jī)科學(xué)與軟件學(xué)院;天津大學(xué)計(jì)算機(jī)科學(xué)與技術(shù)學(xué)院;
【基金】：國(guó)家自然科學(xué)基金項(xiàng)目(61173032,61070136)資助
【分類號(hào)】：TP332

【參考文獻(xiàn)】

相關(guān)期刊論文 前4條

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【共引文獻(xiàn)】

相關(guān)期刊論文 前3條

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【二級(jí)參考文獻(xiàn)】

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3 奚杰;陳杰;朱s，

本文編號(hào)：1568496