本文關(guān)鍵詞：基于投機(jī)執(zhí)行的兩級(jí)退休機(jī)制　出處：《計(jì)算機(jī)應(yīng)用研究》2015年04期 　論文類型：期刊論文

  更多相關(guān)文章： 投機(jī)執(zhí)行 重排序緩存 快速退休 亂序回寫 超標(biāo)量

【摘要】：針對(duì)超標(biāo)量處理器中指令長(zhǎng)時(shí)間占用重排序緩存引起指令退休緩慢的問(wèn)題,提出了一種基于投機(jī)執(zhí)行的兩級(jí)退休機(jī)制。該方案根據(jù)指令有無(wú)異常和預(yù)測(cè)錯(cuò)誤風(fēng)險(xiǎn)將指令分為有風(fēng)險(xiǎn)指令和無(wú)風(fēng)險(xiǎn)指令,對(duì)重排序緩存進(jìn)行輕量化改進(jìn),只有存在異常和預(yù)測(cè)風(fēng)險(xiǎn)的指令才允許進(jìn)重排序緩存,在確認(rèn)風(fēng)險(xiǎn)消除后將指令快速退休。重命名寄存器從重排序緩存分離,負(fù)責(zé)寄存器重命名和結(jié)果亂序回寫。實(shí)驗(yàn)結(jié)果表明,在硬件資源相同的情況下,基于該方案的處理器比傳統(tǒng)的按序退休處理器的性能平均提高28.8%以上。
[Abstract]:In superscalar processors, the problem of slow instruction retirement caused by the long time occupation of reorder cache in superscalar processors is discussed. This paper proposes a two-level retirement mechanism based on speculative execution. The scheme classifies instruction into risk-free instruction and risk-free instruction according to the risk of instruction anomaly and prediction error and improves the reorder cache lightweight. Only instructions with exceptions and prediction risks are allowed to reorder the cache, and the instructions are retired quickly after confirming the risk. The rename register is separated from the resort cache. The experimental results show that the performance of the processor based on this scheme is more than 28.8% higher than that of the traditional sequential retirement processor under the same hardware resources.
【作者單位】： 浙江大學(xué)電氣工程學(xué)院;浙江大學(xué)信息與電子工程學(xué)系;
【基金】：國(guó)家科技重大專項(xiàng)核高基重大專項(xiàng)資助項(xiàng)目(2009ZX01030-001-002)
【分類號(hào)】：TP332
【正文快照】： 0引言隨著科學(xué)技術(shù)的快速發(fā)展,嵌入式系統(tǒng)的應(yīng)用越來(lái)越廣泛,對(duì)嵌入式處理器的性能要求越來(lái)越高。在超標(biāo)量亂序執(zhí)行的嵌入式處理器中,重排序緩存(reorder buffer,ROB)負(fù)責(zé)維護(hù)精確異常、硬件推測(cè)和寄存器重命名等功能。為了保證處理器的效率,重排序緩存的數(shù)目必須大于流水線中

【參考文獻(xiàn)】

相關(guān)博士學(xué)位論文 前1條

1 葛海通;32位高性能嵌入式CPU及平臺(tái)研發(fā)[D];浙江大學(xué);2009年

【共引文獻(xiàn)】

相關(guān)期刊論文 前4條

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本文編號(hào)：1397433