發(fā)布時(shí)間：2017-11-13 16:08

  本文關(guān)鍵詞：一種嵌入式處理器間SPI總線通信優(yōu)化方法

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【摘要】：SPI(Serial Peripheral Interface,串行外設(shè)接口)作為一種全雙工的同步通信總線,常用于嵌入式處理器間的通信。提出一種在P2020處理器與基于Xilinx K7 FPGA芯片的軟核處理器間的SPI總線通信優(yōu)化方法。利用SPI總線雙向同步傳輸?shù)奶攸c(diǎn),提出一種簡易且有效的通信協(xié)議保證通信質(zhì)量;根據(jù)SPI總線兩端處理器的時(shí)鐘頻率,設(shè)置SPI總線波特率,提升數(shù)據(jù)傳輸速率;同時(shí),考慮SPI總線兩端處理器的處理頻率的差異,設(shè)置合理數(shù)據(jù)傳輸延遲,保證數(shù)據(jù)傳輸?shù)恼_性和穩(wěn)定性。實(shí)驗(yàn)結(jié)果表示,該SPI總線通信方法在上述平臺中能夠達(dá)到750KR/S的通信速率,能夠滿足多種嵌入式平臺的數(shù)據(jù)傳輸需求。
【作者單位】： 中航工業(yè)西安航空計(jì)算技術(shù)研究所;機(jī)載彈載計(jì)算機(jī)航空科技重點(diǎn)實(shí)驗(yàn)室;
【基金】：中航工業(yè)技術(shù)創(chuàng)新基金項(xiàng)目資助(2014D63130R) 航空科學(xué)基金項(xiàng)目資助(2015ZC31005)
【分類號】：TP336;TP332
【正文快照】： 引言 設(shè)備控制和發(fā)起,從設(shè)備無法主動控制通信過程,導(dǎo)致在由同構(gòu)/異構(gòu)多處理器組}0系統(tǒng)中,根據(jù)灥 SPI通信方式存在缺少流控制機(jī)制、校驗(yàn)和應(yīng)答機(jī)制、任務(wù)的不同,處理器間通常會有較頻繁的數(shù)據(jù)通信。數(shù)據(jù)幀機(jī)制等[1_2]。本文針對這些問題,研究K020嵌人式平臺處理期間通信通常采

【相似文獻(xiàn)】

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