【摘要】：彈上引信系統(tǒng)是否能夠可靠穩(wěn)定工作決定著武器效能能否充分發(fā)揮,因此,在應(yīng)用環(huán)境下驗(yàn)證引信輸出信號(hào)質(zhì)量是否符合系統(tǒng)設(shè)計(jì)要求就變得非常必要。根據(jù)某所需求要設(shè)計(jì)一種對(duì)某引信輸出的高頻脈沖編碼信號(hào)采集存儲(chǔ)裝置(采樣速度≥500MHz、分辨率不低于8bit、輸入阻抗≥1MΩ、輸入電容≤8pF等)。根據(jù)指標(biāo)要求以及在繼承先前研究的基礎(chǔ)上,本文優(yōu)化設(shè)計(jì)了一種以FPGA為主控,SSRAM和Flash為存儲(chǔ)介質(zhì)的采樣頻率達(dá)500MHz的彈上高頻脈沖記錄儀。先前研究設(shè)計(jì)的記錄儀存在發(fā)熱、ADC適配不足、阻抗不匹配等問題或不足。本文針對(duì)存在的問題,以傳輸線理論和信噪比為基礎(chǔ),在充分考慮電路中傳輸線效應(yīng)和電阻電容的分布參數(shù)對(duì)的電路影響下,重點(diǎn)對(duì)頻率補(bǔ)償分壓器電路、ADC的前后端匹配、數(shù)字電源的耦合電容等電路作了詳細(xì)的設(shè)計(jì)和優(yōu)化。以噪聲和信噪比為考量參數(shù),在阻抗變換、ADC前端匹配、采樣時(shí)鐘、模擬電源等電路的設(shè)計(jì)和優(yōu)化過程中作了噪聲和信噪比的相關(guān)分析。以傳輸線的分布參數(shù)為基礎(chǔ)對(duì)記錄儀硬件電路PCB進(jìn)行仿真設(shè)計(jì)。利用軟件Polar SI9000對(duì)PCB層疊結(jié)構(gòu)和阻抗控制作了詳細(xì)的設(shè)計(jì)。以高速電路PCB設(shè)計(jì)常用的約束驅(qū)動(dòng)原則,借助EDA軟件Cadence分別進(jìn)行了PCB層疊結(jié)構(gòu)設(shè)計(jì)、LVDS信號(hào)線和關(guān)鍵單端微帶線信號(hào)完整性仿真分析和PCB布局布線。記錄儀的邏輯設(shè)計(jì)部分對(duì)存儲(chǔ)器進(jìn)行了邏輯功能仿真。性能測試結(jié)果表明記錄儀得到了優(yōu)化改進(jìn),實(shí)現(xiàn)了采樣速度500MHz、分辨率12bit、輸入阻抗1MΩ、輸入電容5p F等性能參數(shù),達(dá)到了技術(shù)指標(biāo)要求。
【學(xué)位授予單位】：中北大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2019
【分類號(hào)】：TJ410.3
【圖文】：

圖 2.7 cyclone III PLL 時(shí)鐘抖動(dòng)）ADC 適配不足和阻抗不匹配的研究設(shè)計(jì)中并沒有專門做阻抗匹配，引信輸出編碼信號(hào)經(jīng)分壓后直運(yùn)放 AD8138，測試結(jié)果出現(xiàn)消頂現(xiàn)象。分析發(fā)現(xiàn)，因分壓電路和驅(qū)

原始引信信號(hào)

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本文編號(hào)：2715051