【摘要】：某型號雷達(dá)電子干擾機(jī)用于實(shí)現(xiàn)對雷達(dá)的欺騙干擾,降低其對真實(shí)目標(biāo)的跟蹤、識別能力。為提升干擾機(jī)的智能化程度,需根據(jù)加載數(shù)據(jù)實(shí)時(shí)進(jìn)行參數(shù)計(jì)算,生成干擾決策參數(shù)表,并以此實(shí)施干擾。因此干擾機(jī)需完成復(fù)雜參數(shù)計(jì)算,以及高速信號處理功能。常規(guī)的做法是使用FPGA完成信號處理,另需要一片DSP(或單片機(jī))等處理器芯片完成復(fù)雜計(jì)算。根據(jù)產(chǎn)品小型化的設(shè)計(jì)需求,本文采用SOPC技術(shù)實(shí)現(xiàn)干擾決策通用平臺設(shè)計(jì)。本文圍繞Xilinx公司的軟核處理器MicroBlaze,采用嵌入式開發(fā)套件EDK,將MicroBlaze嵌入到FPGA中,搭建出干擾決策技術(shù)的嵌入式系統(tǒng),并給出了系統(tǒng)整體以及軟硬件各個(gè)模塊設(shè)計(jì)的實(shí)現(xiàn)。取代以往DSP(或單片機(jī))+FPGA的工作模式,僅用一片F(xiàn)PGA實(shí)現(xiàn)產(chǎn)品全部功能。該設(shè)計(jì)不僅縮小了板卡的尺寸,降低了功耗,而且配置靈活,裁剪擴(kuò)充方便、升級快速簡單等特點(diǎn)。本文首先針對MicroBlaze自身結(jié)構(gòu)特點(diǎn)和工作原理進(jìn)行了簡單的剖析,而后對MicroBlaze開發(fā)流程進(jìn)行學(xué)習(xí)。按照系統(tǒng)的硬件平臺化設(shè)計(jì)思路及軟件流程圖,開始各功能模塊設(shè)計(jì)。完成了接收加載數(shù)據(jù)、復(fù)雜參數(shù)計(jì)算、實(shí)時(shí)偵收雷達(dá)信號、進(jìn)行相參壓制干擾信號調(diào)制、欺騙干擾信號調(diào)制、發(fā)送干擾信號等主要功能模塊的設(shè)計(jì)。結(jié)合仿真試驗(yàn)以及干擾機(jī)系統(tǒng)聯(lián)試結(jié)果,表明該系統(tǒng)能夠?qū)崿F(xiàn)雷達(dá)電子干擾機(jī)的相參壓制與欺騙復(fù)合干擾策略,能可靠、穩(wěn)定地工作。
【圖文】：

圖 2-2 干擾信號時(shí)域波形及其頻譜圖 2-3 雷達(dá)脈沖壓縮效果波形件為相參信息 25-100ns 隨機(jī)出現(xiàn)，如圖 2-4、圖（雷達(dá)帶寬 5MHz），干擾信號信噪比可以達(dá)到 各類雜波目標(biāo)信號練成一片，雷達(dá)無法分辨真實(shí)

圖 2-3 雷達(dá)脈沖壓縮效果波形件為相參信息 25-100ns 隨機(jī)出現(xiàn)，如圖 2-4、圖（雷達(dá)帶寬 5MHz），，干擾信號信噪比可以達(dá)到 各類雜波目標(biāo)信號練成一片，雷達(dá)無法分辨真實(shí)擾效果。圖 2-4 干擾信號時(shí)域波形及其頻譜
【學(xué)位授予單位】：哈爾濱工業(yè)大學(xué)
【學(xué)位級別】：碩士
【學(xué)位授予年份】：2016
【分類號】：TN974

【參考文獻(xiàn)】

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本文編號：2688202