本文關鍵詞：基于Vivado HLS的Down Scaler視頻系統(tǒng)設計

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【摘要】：介紹一種基于FPGA的Down Scaler視頻系統(tǒng)設計。系統(tǒng)的核心部件采用Xilinx Kintex-7的板載XC7K325T芯片,系統(tǒng)設計使用Vivado工具,包括使用Vivado HLS進行Down Scaler模塊設計。首先按照Vivado HLS的代碼規(guī)范進行Down Scaler模塊的C/C++代碼編寫,然后利用編譯工具生成RTL級代碼和綜合結果 Down Scaler IP核,最后將Down Scaler IP核與TPG、VDMA等Xilinx視頻IP核互連,構建實時視頻系統(tǒng)。在滿足實時性要求和FPGA資源消耗要求的條件下,該設計實現(xiàn)了對Down Scaler視頻算法從PC端軟件處理方式向FPGA平臺硬件處理方式的移植。
【作者單位】： 西安電子科技大學微電子學院;
【關鍵詞】： Vivado HLS FPGA Down Scaler 高層次綜合
【分類號】：TN791
【正文快照】： 引言在電子設計自動化領域,高層次綜合工具變得越來越受歡迎,其能夠將C/C++、SystemC、Matlab等高級語言的函數(shù)轉譯成RTL級的代碼,這一功能將數(shù)字電路設計的抽象層進一步提升。隨著嵌入式系統(tǒng)復雜程度的增加,高層次綜合工具開始深入電子系統(tǒng)尤其是嵌入式系統(tǒng)的設計流程。本文

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