本文關(guān)鍵詞：低溫漂系數(shù)共源共柵CMOS帶隙基準(zhǔn)電壓源

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【摘要】：設(shè)計了一種低溫漂系數(shù)的共源共柵CMOS帶隙基準(zhǔn)源,采用自偏置共源共柵結(jié)構(gòu),提高了電路的電源抑制比,降低了電路的工作電源電壓。采用不同溫度下從輸出支路抽取不同值電流的電路結(jié)構(gòu),在低溫段抽取一個正溫度系數(shù)電流,在高溫段再注入一個較小值的正溫度系數(shù)電流,達到降低溫漂系數(shù)的目的。在0.5μm CMOS工藝下,Cadence Spectre電路仿真的結(jié)果表明,溫度特性得到了較大改善,在-35℃~125℃溫度范圍內(nèi),帶隙基準(zhǔn)源的溫漂系數(shù)為1.5×10~(-6)/℃,電源抑制比為65dB。
【作者單位】： 湘潭大學(xué)微電子科學(xué)與工程系;
【關(guān)鍵詞】： 帶隙基準(zhǔn)電壓源 共源共柵 低溫漂系數(shù) 電流抽取
【基金】：國家自然科學(xué)基金資助項目(61471310)
【分類號】：TN432
【正文快照】： 1引言帶隙基準(zhǔn)電壓源作為基本參考源,為功能模塊提供高精度的電壓基準(zhǔn)或者高精度的電流基準(zhǔn),廣泛應(yīng)用于A/D和D/A轉(zhuǎn)換器、開關(guān)電源等電路中,其電壓穩(wěn)定性、溫度特性、抗噪聲能力等直接影響功能模塊甚至系統(tǒng)的精度和性能。常用帶隙基準(zhǔn)電壓源電路一般采用含有運算放大器的電路結(jié)

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本文編號：858219