本文關(guān)鍵詞：基于FPGA的改進(jìn)結(jié)構(gòu)的DDS設(shè)計(jì)與實(shí)現(xiàn)

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【摘要】：主要介紹了數(shù)字頻率合成器的原理和雜散來(lái)源,給出了節(jié)約存儲(chǔ)空間的ROM表的壓縮算法,采用相位抖動(dòng)和平衡DAC方法對(duì)DDS結(jié)構(gòu)進(jìn)行了改進(jìn),抑制了相位截?cái)嗾`差和減小了DAC非理想特性的影響。仿真分析了用于相位抖動(dòng)的隨機(jī)序列周期性對(duì)雜散的影響,最后基于FPGA平臺(tái)實(shí)現(xiàn)了改進(jìn)結(jié)構(gòu)的DDS,并對(duì)結(jié)果進(jìn)行了測(cè)試。測(cè)試結(jié)果表明DDS用作跳頻器時(shí),雜散抑制優(yōu)于40 dBc。采用此種方法設(shè)計(jì)的DDS雜散抑制度高,穩(wěn)定性好,性能優(yōu)越。
【作者單位】： 哈爾濱工業(yè)大學(xué)通信技術(shù)研究所;
【關(guān)鍵詞】： DDS 雜散抑制 相位抖動(dòng) FPGA
【基金】：國(guó)家重點(diǎn)基礎(chǔ)研究發(fā)展計(jì)劃(61301101) 國(guó)家自然科學(xué)基金項(xiàng)目(2013CB329003)
【分類號(hào)】：TN741
【正文快照】： 0引言跳頻系統(tǒng)由于抗干擾能力強(qiáng)被廣泛應(yīng)用,其中最重要的器件為頻率合成器,它決定了系統(tǒng)的性能。越來(lái)越多的設(shè)備都依賴于頻率合成技術(shù),所以頻率源可以稱作為許多電子系統(tǒng)的“心臟”。數(shù)字頻率合成器(DirectDigital Synthesizer,DDS)由于具有頻率分辨率高、轉(zhuǎn)換時(shí)間快、相位噪，

本文編號(hào)：533032