本文關(guān)鍵詞：一種基于FPGA進位鏈的時間數(shù)字轉(zhuǎn)換器，由筆耕文化傳播整理發(fā)布。

【摘要】：提出了一種基于Xilinx Virtex-5FPGA的時間數(shù)字轉(zhuǎn)換器。利用Virtex-5中專用進位鏈CARRY4構(gòu)造的延遲鏈,對時鐘周期進行內(nèi)插以得到更高精度的測量。此外,運用布局布線約束來減少延遲鏈的不一致性,降低了微分非線性(DNL)以及積分非線性(INL)。仿真結(jié)果表明,最低有效位(LSB)為52.22ps,精度(RMS)約為25ps,INL為0~0.9LSB,DNL為-0.03~0.1LSB。
【作者單位】： 重慶郵電大學光電工程學院/國際半導體學院;
【關(guān)鍵詞】： 時間數(shù)字轉(zhuǎn)換器 進位鏈 CARRY 布局布線 可編程邏輯器件
【基金】：國家自然科學基金資助項目(61404019)
【分類號】：TN791
【正文快照】： 1引言時間數(shù)字轉(zhuǎn)換器(TDC)是一種用來測量時間的電路,它將攜帶時間信息的模擬信號轉(zhuǎn)換為數(shù)字信號,從而實現(xiàn)時間測量的數(shù)字化[1]。它主要應(yīng)用于飛行時間測量(TOF)、正電子成像技術(shù)(PET),以及激光、雷達、示波器等多種科學和工程領(lǐng)域[2]。TDC電路的設(shè)計可分為全定制設(shè)計(ASIC)和

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