基于FPGA的大規(guī)模脈沖深度神經(jīng)網(wǎng)絡(luò)片上系統(tǒng)設(shè)計與研究
本文關(guān)鍵詞:基于FPGA的大規(guī)模脈沖深度神經(jīng)網(wǎng)絡(luò)片上系統(tǒng)設(shè)計與研究,由筆耕文化傳播整理發(fā)布。
【摘要】:自深度神經(jīng)網(wǎng)絡(luò)被提出以來,就因其在處理實際問題中所表現(xiàn)的優(yōu)秀性能而成為人工神經(jīng)網(wǎng)絡(luò)的主流研究方向。但是,隨著深度神經(jīng)網(wǎng)絡(luò)研究的不斷深入以及處理問題的復(fù)雜度不斷增加,深度神經(jīng)網(wǎng)絡(luò)的網(wǎng)絡(luò)規(guī)模和網(wǎng)絡(luò)計算復(fù)雜度也隨之成倍提升。總體來說,在深度神經(jīng)網(wǎng)絡(luò)的計算中存在著存儲復(fù)雜度高,計算復(fù)雜度高,數(shù)據(jù)傳輸帶寬大的挑戰(zhàn)。論文的研究目的是設(shè)計一種面向嵌入式系統(tǒng)的深度神經(jīng)網(wǎng)絡(luò)計算協(xié)處理器,用以實現(xiàn)低功耗,高效的大規(guī)模深度神經(jīng)網(wǎng)絡(luò)實時計算。論文通過對包括對深度置信網(wǎng)絡(luò)和卷積神經(jīng)網(wǎng)絡(luò)兩種網(wǎng)絡(luò)模型的主流神經(jīng)網(wǎng)絡(luò)模型中存在的計算和存儲復(fù)雜的問題進行研究,提出了一種面向硬件友好的脈沖深度神經(jīng)網(wǎng)絡(luò)模型及其訓(xùn)練算法,并且據(jù)此設(shè)計了一種基于片上系統(tǒng)的,具有可擴展性和一致性的高速脈沖深度神經(jīng)網(wǎng)絡(luò)計算協(xié)處理器。論文的主要研究成果如下:(1)提出了一種脈沖驅(qū)動的深度神經(jīng)網(wǎng)絡(luò)模型及其訓(xùn)練算法。論文通過綜合分析具有較強實際問題處理能力的深度神經(jīng)網(wǎng)絡(luò)模型以及在硬件實現(xiàn)中具有易于實現(xiàn)和低功耗特點的脈沖神經(jīng)網(wǎng)絡(luò)模型,提出了包含脈沖深度置信網(wǎng)絡(luò)和脈沖卷積神經(jīng)網(wǎng)絡(luò)在內(nèi)的脈沖深度神經(jīng)網(wǎng)絡(luò)模型及其訓(xùn)練算法。(2)設(shè)計了一種通用的脈沖深度神經(jīng)網(wǎng)絡(luò)存儲和計算硬件架構(gòu)。為了實現(xiàn)兼容脈沖深度置信網(wǎng)絡(luò)和脈沖卷積神經(jīng)網(wǎng)絡(luò)兩種網(wǎng)絡(luò)模型的存儲和計算,論文提出了將兩種網(wǎng)絡(luò)模型轉(zhuǎn)換得到一致的稀疏前饋網(wǎng)絡(luò)結(jié)構(gòu),然后設(shè)計了一種基于索引查找表的一致性硬件架構(gòu)來實現(xiàn)對轉(zhuǎn)換后的脈沖深度神經(jīng)網(wǎng)絡(luò)進行計算,并且在硬件架構(gòu)設(shè)計中引入了層次化流水和低功耗的硬件優(yōu)化設(shè)計來提高硬件的計算效率,降低硬件的計算功耗。(3)設(shè)計實現(xiàn)了一種基于Xilinx片上系統(tǒng)的,針對脈沖深度神經(jīng)網(wǎng)絡(luò)的,具有一致性、低功耗特性的脈沖深度神經(jīng)網(wǎng)絡(luò)計算協(xié)處理器,并對其進行綜合驗證分析,最終實現(xiàn)了原型系統(tǒng)的設(shè)計與驗證。
【關(guān)鍵詞】:脈沖深度神經(jīng)網(wǎng)絡(luò) 索引查找表 片上系統(tǒng) 協(xié)處理器
【學(xué)位授予單位】:重慶大學(xué)
【學(xué)位級別】:碩士
【學(xué)位授予年份】:2016
【分類號】:TP183;TN791
【目錄】:
- 中文摘要3-4
- 英文摘要4-7
- 1 緒論7-13
- 1.1 引言7
- 1.2 研究背景及意義7-8
- 1.3 研究現(xiàn)狀8-11
- 1.3.1 專用加速計算硬件研究8-9
- 1.3.2 脈沖神經(jīng)網(wǎng)絡(luò)硬件實現(xiàn)9-11
- 1.4 研究內(nèi)容及章節(jié)安排11-13
- 2 脈沖深度神經(jīng)網(wǎng)絡(luò)13-33
- 2.1 主流深度神經(jīng)網(wǎng)絡(luò)模型與算法13-17
- 2.1.1 深度置信網(wǎng)絡(luò)模型與算法13-15
- 2.1.2 卷積神經(jīng)網(wǎng)絡(luò)模型與算法15-17
- 2.2 脈沖神經(jīng)網(wǎng)絡(luò)模型17-22
- 2.2.1 脈沖響應(yīng)模型19
- 2.2.2 累積釋放模型19-21
- 2.2.3 脈沖神經(jīng)網(wǎng)絡(luò)模型21-22
- 2.3 脈沖深度置信網(wǎng)絡(luò)與算法22-28
- 2.3.1 脈沖深度置信網(wǎng)絡(luò)模型22-25
- 2.3.2 脈沖深度置信網(wǎng)絡(luò)訓(xùn)練算法25-28
- 2.4 脈沖卷積神經(jīng)網(wǎng)絡(luò)與算法28-33
- 2.4.1 脈沖卷積神經(jīng)網(wǎng)絡(luò)模型28-30
- 2.4.2 脈沖卷積神經(jīng)網(wǎng)絡(luò)訓(xùn)練算法30-33
- 3 脈沖深度神經(jīng)網(wǎng)絡(luò)硬件架構(gòu)設(shè)計33-47
- 3.1 硬件架構(gòu)設(shè)計思路與指標(biāo)33-34
- 3.1.1 硬件架構(gòu)設(shè)計思路33
- 3.1.2 硬件架構(gòu)設(shè)計關(guān)鍵指標(biāo)33-34
- 3.2 索引查找表結(jié)構(gòu)34-38
- 3.2.1 稀疏前饋型脈沖深度神經(jīng)網(wǎng)絡(luò)結(jié)構(gòu)34-36
- 3.2.2 基于索引查找表的網(wǎng)絡(luò)存儲結(jié)構(gòu)36-38
- 3.3 脈沖深度神經(jīng)網(wǎng)絡(luò)計算協(xié)處理器架構(gòu)38-40
- 3.3.1 脈沖神經(jīng)網(wǎng)絡(luò)處理單元38-39
- 3.3.2 脈沖深度神經(jīng)網(wǎng)絡(luò)計算協(xié)處理器架構(gòu)39-40
- 3.4 多層次流水線設(shè)計40-45
- 3.4.1 協(xié)處理器頂層流水線設(shè)計40-41
- 3.4.2 脈沖神經(jīng)網(wǎng)絡(luò)處理單元內(nèi)部流水線設(shè)計41-44
- 3.4.3 底層子模塊流水線設(shè)計44-45
- 3.5 低功耗設(shè)計45-47
- 4 脈沖深度神經(jīng)網(wǎng)絡(luò)計算協(xié)處理器硬件設(shè)計47-61
- 4.1 脈沖深度神經(jīng)網(wǎng)絡(luò)計算協(xié)處理器頂層設(shè)計47-48
- 4.2 脈沖神經(jīng)網(wǎng)絡(luò)處理單元設(shè)計與驗證48-56
- 4.2.1 脈沖神經(jīng)網(wǎng)絡(luò)計算單元49-50
- 4.2.2 事件地址表控制器模塊50-51
- 4.2.3 權(quán)值參數(shù)表控制器模塊51-53
- 4.2.4 乘累加計算模塊53-54
- 4.2.5 閾值函數(shù)計算模塊54-55
- 4.2.6 單元工作狀態(tài)控制模塊55-56
- 4.3 綜合仿真結(jié)果及分析56-61
- 5 協(xié)處理器原型系統(tǒng)設(shè)計與實現(xiàn)61-69
- 5.1 原型系統(tǒng)設(shè)計61-65
- 5.1.1 原型系統(tǒng)平臺61-62
- 5.1.2 原型系統(tǒng)軟件設(shè)計62-64
- 5.1.3 原型系統(tǒng)集成64-65
- 5.2 原型系統(tǒng)功能驗證和性能測試65-67
- 5.3 基于深度學(xué)習(xí)網(wǎng)絡(luò)的視覺輔助駕駛系統(tǒng)67-69
- 6 總結(jié)與展望69-71
- 6.1 工作總結(jié)69-70
- 6.2 工作展望70-71
- 致謝71-73
- 參考文獻(xiàn)73-77
- 附錄77
- A. 作者在攻讀學(xué)位期間申請的專利77
- B. 作者在攻讀學(xué)位期間的獲獎情況77
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本文關(guān)鍵詞:基于FPGA的大規(guī)模脈沖深度神經(jīng)網(wǎng)絡(luò)片上系統(tǒng)設(shè)計與研究,由筆耕文化傳播整理發(fā)布。
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