基于QFP封裝級(jí)電源分配網(wǎng)絡(luò)的建模及阻抗計(jì)算
【學(xué)位單位】:西安電子科技大學(xué)
【學(xué)位級(jí)別】:碩士
【學(xué)位年份】:2019
【中圖分類】:TN705
【部分圖文】:
圖 1.1 DIP 封裝模型圖功能等方面的限制因素,傳統(tǒng)芯片多采用 DIP 形式特定的場(chǎng)合下還會(huì)采用單列直插式封裝(Single In—相對(duì)于其他主流的封裝形式,該封裝所占的空間
圖 1.2 貼片式常用封裝模型圖片貼片式常用封裝包括小外型封裝(Small Outline Package, SOP)、塑封有引線芯體(Plastic Leaded Chip Carrier, PLCC)、無(wú)引線陶瓷芯片載體(Leadless Ceramic Carrier, LCCC)以及方形扁平封裝 QFP[13],如圖 1.2 所示。貼片式封裝經(jīng)過(guò)長(zhǎng)期飛
圖 1.3 BGA 圖片封裝包括塑封球柵陣列封裝(Plastic Baic Ball Grid Array, CBGA),陶瓷柱柵陣帶球柵陣列封裝(Tape Ball GridArray,
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本文編號(hào):2852092
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