基于FPGA的語(yǔ)音壓縮G729協(xié)議的AXI總線設(shè)計(jì)與驗(yàn)證
【學(xué)位授予單位】:東南大學(xué)
【學(xué)位級(jí)別】:碩士
【學(xué)位授予年份】:2018
【分類號(hào)】:TN912.3;TN791
【圖文】:
圖1-1典型VOIP系統(tǒng)逡逑1逡逑
復(fù)雜橋接的情況下進(jìn)行高頻操作,同時(shí)也為互連結(jié)構(gòu)的實(shí)現(xiàn)提供極大的靈活性。AX丨總線包含了邋5逡逑個(gè)不同的通道,用以描述待傳輸數(shù)據(jù)特性。分別是讀地址通道、讀數(shù)據(jù)通道、寫(xiě)地址通道、寫(xiě)數(shù)據(jù)逡逑通道以及寫(xiě)響應(yīng)通道,具體如圖2-1所示。逡逑邐M邐逡逑Write邋Address/Conlrol邋)逡逑^邐Awready邐逡逑邐\逡逑Wrilc邋Data邐)逡逑_^逡逑^邐Wready邐逡逑^邐逡逑Master邋\邐Write邋Response邐Slave逡逑Interface邋\J邐Interface逡逑邐Bready邋邐?逡逑邐'\逡逑Read邋Address/Control邋〉逡逑4邐Arrcadv邐逡逑/I邐逡逑\邐Read邋Data逡逑邐Rready邋邐?逡逑圖2-1單主從設(shè)備間AXI總線通道互連逡逑圖2-1展示了單主從設(shè)備間的總線互連通道,即點(diǎn)對(duì)點(diǎn)式互連。單主從設(shè)備間的數(shù)據(jù)傳輸無(wú)外逡逑乎兩種情況,一種是主設(shè)備向從設(shè)備寫(xiě)數(shù)據(jù),此時(shí)需用到寫(xiě)地址、寫(xiě)數(shù)據(jù)和寫(xiě)響應(yīng)通道。主設(shè)備通逡逑過(guò)WriteAddress/Control通道,告知從設(shè)備此次寫(xiě)交易的傳輸特性,包括地址信息、采用的傳輸機(jī)逡逑制、緩存機(jī)制、訪問(wèn)機(jī)制等,從設(shè)備按照約定好的規(guī)范接收并存儲(chǔ)來(lái)自主設(shè)備Write邋Data通道上的逡逑數(shù)據(jù)并通過(guò)Awready和Wready握手信號(hào)保證寫(xiě)數(shù)據(jù)的正確傳輸。寫(xiě)響應(yīng)通道目的是建立主從設(shè)備逡逑之間的安全傳輸機(jī)制,當(dāng)一次寫(xiě)交易完成,從設(shè)備通過(guò)Write邋Response通道反饋給主設(shè)備此次寫(xiě)交逡逑易的傳輸狀態(tài)
\J邋|邐if邋!邐|7—pf—|邐h\_逡逑圖2-2邋AXI讀突發(fā)傳輸時(shí)序圖逡逑圖2-3為一個(gè)基本的寫(xiě)Burst操作的時(shí)序圖,主設(shè)備通過(guò)寫(xiě)地址通道發(fā)起兩次寫(xiě)交易請(qǐng)求的同時(shí)逡逑通過(guò)寫(xiě)數(shù)據(jù)通道發(fā)送有效寫(xiě)數(shù)據(jù),這樣做可以減少寫(xiě)操作的寫(xiě)延時(shí)。圖2-3采用確認(rèn)寫(xiě)地址接收完逡逑畢后才發(fā)送寫(xiě)數(shù)據(jù)的控制策略。主設(shè)備的AWVALID信號(hào)及地址控制信號(hào)應(yīng)該一直保持有效直到從逡逑設(shè)備確認(rèn)接收。寫(xiě)數(shù)據(jù)通道的WVALID和寫(xiě)數(shù)據(jù)亦然。WLAST信號(hào)在寫(xiě)交易的最后一次寫(xiě)傳輸時(shí)逡逑拉高,當(dāng)從設(shè)備接收完所有的數(shù)據(jù)時(shí),應(yīng)該通過(guò)寫(xiě)響應(yīng)通道
【參考文獻(xiàn)】
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本文編號(hào):2795622
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