一種特殊應(yīng)用場景下的DDR4寫緩沖設(shè)計與驗證
【圖文】:
2.2邋DDR4邋SDRAM的工作原理逡逑除了上節(jié)講述的結(jié)構(gòu)部分,DDR4內(nèi)部的工作也是一個十分復(fù)雜的過程,下逡逑圖2_2是一個比較典型的簡易DDR4工作狀態(tài)轉(zhuǎn)換圖。這個簡化的狀態(tài)圖提供了逡逑可能的狀態(tài)轉(zhuǎn)換需要的命令,涉及到多個Bank的情況,包含啟用或者禁止片上逡逑終止,并沒有完全描述DDR4操作的所有事件。逡逑From邋any邋state邐*邋skx邋N0f-^逡逑r7^逡逑—?/Power叫一邋RESET—(pr0ce邋W(mual丨~枺掊澹ǎ蓿╁危ㄥ澹潁澹媯潁澹螅楨澹╁義希鄭蓿危ǎ悖幔眨猓潁幔簦蓿?.0^.^/邋.d.e逦.f二AP峰義纖妗瑰,NB廣卜、逡逑;A\逡逑P£)X逡逑active逡逑white邐v/nn:邐y>-.邐?£AD逡逑Q^.,邐.廣^逡逑f邋Writing邐\、邐?、Readmg
:|邋Tirmr邋Break邋|邋j邋Transitioning邋Data邋\///\邋tk>n'l邋Care逡逑圖2-3突發(fā)寫操作逡逑在WRITE命令發(fā)出之后,數(shù)據(jù)到達(dá)數(shù)據(jù)總線DQ的時間:WL=CWL+AL=9CBurst數(shù)據(jù)量需要4個時鐘周期傳輸完。在不做任何調(diào)度的情況下,后續(xù)作分為幾種情況討論。逡逑果當(dāng)前訪問的Bank己經(jīng)打開,且命中上次訪問的行,貝!J訪問時間短,簡中。逡逑果當(dāng)前訪問的Bank己經(jīng)打開,但沒有命中上次訪問的行,則訪問時間最頁不命中。逡逑果當(dāng)前訪問的Bank沒有打開,則訪問時間處于上述兩者之間,簡稱頁關(guān)表2-3發(fā)射命令表逡逑情況分類邐|后續(xù)命令邐|帶寬利用率逡逑中邐WRITE邐高逡逑命中邐PRE+ACT+WRITE邐極低逡逑
【學(xué)位授予單位】:安徽大學(xué)
【學(xué)位級別】:碩士
【學(xué)位授予年份】:2019
【分類號】:TN305
【相似文獻(xiàn)】
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,本文編號:2597062
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