【摘要】：針對現(xiàn)場可編程門陣列(FPGA)的布線擁擠問題,為了提高布通率,提出了基于異步串行鏈接的FPGA布線框架,該框架由異步串行收發(fā)器和相應(yīng)的快速布線算法組成,最大優(yōu)勢是將串行線路的合理框架成功應(yīng)用于FPGA。首先,在FPGA中添加異步串行收發(fā)器;然后,運用post-routing算法更新FPGA布線,選擇非關(guān)鍵且足夠長的導線段附近的最優(yōu)組,對其進行串行化。最后,異步串行數(shù)據(jù)傳輸后,將信號反串行化成并行信號。實驗結(jié)果顯示,在面積和功耗的代價合理的情況下,利用異步數(shù)據(jù)串行化能有效減少布線數(shù)量和布線擁擠(分別為18.81%和48.73%),同時系統(tǒng)性能并未有任何下降。該算法可用于開發(fā)集成度更高、更復雜的FPGA。

【相似文獻】

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