片上網(wǎng)絡(luò)中路由器的設(shè)計(jì)
本文關(guān)鍵詞:片上網(wǎng)絡(luò)中路由器的設(shè)計(jì),由筆耕文化傳播整理發(fā)布。
【摘要】:隨著半導(dǎo)體技術(shù)的發(fā)展,人們?cè)絹?lái)越關(guān)注采用并行的方法來(lái)提高芯片的整體性能。多核芯片(Chip Multi-Processors, CMPs)應(yīng)運(yùn)而生,其將多個(gè)IP核集成在一個(gè)芯片上,使芯片集成度迅速增加。多核之間的通信問(wèn)題制約了多核芯片的發(fā)展,而片上網(wǎng)絡(luò)(Network on Chip, NoC)技術(shù)被認(rèn)為是解決多核芯片通信問(wèn)題的重要技術(shù)。片上網(wǎng)絡(luò)可以有效解決傳統(tǒng)的總線所帶來(lái)的能耗過(guò)大、帶寬利用不足和數(shù)據(jù)阻塞等問(wèn)題。片上網(wǎng)絡(luò)通過(guò)多個(gè)路由器彼此相連來(lái)實(shí)現(xiàn),路由器的性能直接影響著片上網(wǎng)絡(luò)的性能,傳統(tǒng)的路由器已經(jīng)無(wú)法滿足片上網(wǎng)絡(luò)日益增長(zhǎng)的性能需求,因此研究高性能的路由器對(duì)提高片上網(wǎng)絡(luò)的性能起到至關(guān)重要的作用。本課題首先對(duì)片上網(wǎng)絡(luò)的整體結(jié)構(gòu)、現(xiàn)存的常見(jiàn)問(wèn)題及路由器的通用架構(gòu)進(jìn)行了概述。然后對(duì)路由器的設(shè)計(jì)方案進(jìn)行了研究,包括數(shù)據(jù)傳輸方案的設(shè)計(jì)、網(wǎng)絡(luò)接口方案的設(shè)計(jì)、路由方案的設(shè)計(jì)及通道分配方案的設(shè)計(jì)。接著根據(jù)以上方案對(duì)路由器進(jìn)行了硬件實(shí)現(xiàn),設(shè)計(jì)了基于AHB協(xié)議的高效網(wǎng)絡(luò)接口;設(shè)計(jì)了基于lookahead路由技術(shù)、虛通道技術(shù)和容錯(cuò)路由算法的路由器輸入模塊;在研究了傳統(tǒng)的分離式分配器的基礎(chǔ)上,提出了矩陣對(duì)角線虛通道分配器和開(kāi)關(guān)分配器。最后對(duì)路由器進(jìn)行了功能仿真和性能分析,通過(guò)軟件仿真和FPGA驗(yàn)證保證了路由器的功能正確;通過(guò)DC綜合表明,本設(shè)計(jì)的時(shí)鐘頻率可以達(dá)到333MHz;通過(guò)Noxim仿真平臺(tái)對(duì)性能進(jìn)行分析,將本課題中的路由器與傳統(tǒng)路由器及組合路由器進(jìn)行性能對(duì)比。本課題所提出的路由器在通道的匹配率方面明顯高于傳統(tǒng)路由器,平均吞吐率達(dá)到40flits/cycle,比組合路由器的吞吐率平均高出7%,數(shù)據(jù)包最低延時(shí)為10個(gè)時(shí)鐘周期,比傳統(tǒng)方案的數(shù)據(jù)包延時(shí)降低了10%。本課題設(shè)計(jì)的片上網(wǎng)絡(luò)路由器在匹配率、吞吐率和數(shù)據(jù)延時(shí)方面有明顯的優(yōu)勢(shì),適用于多種拓?fù)浣Y(jié)構(gòu)的片上網(wǎng)絡(luò),對(duì)未來(lái)片上網(wǎng)絡(luò)的研究及多核芯片的發(fā)展具有重要價(jià)值。
【關(guān)鍵詞】:片上網(wǎng)絡(luò) 路由器 網(wǎng)絡(luò)接口 容錯(cuò)路由算法 矩陣對(duì)角線分配器
【學(xué)位授予單位】:東南大學(xué)
【學(xué)位級(jí)別】:碩士
【學(xué)位授予年份】:2016
【分類號(hào)】:TN47;TN915.05
【目錄】:
- 摘要4-5
- Abstract5-9
- 第一章 緒論9-15
- 1.1 課題背景與意義9-10
- 1.2 國(guó)內(nèi)外研究現(xiàn)狀10-12
- 1.2.1 國(guó)外研究現(xiàn)狀10-11
- 1.2.2 國(guó)內(nèi)研究現(xiàn)狀11-12
- 1.3 研究?jī)?nèi)容與設(shè)計(jì)指標(biāo)12-13
- 1.3.1 研究?jī)?nèi)容12
- 1.3.2 設(shè)計(jì)指標(biāo)12-13
- 1.4 論文結(jié)構(gòu)13-15
- 第二章 片上網(wǎng)絡(luò)路由器概述15-23
- 2.1 片上網(wǎng)絡(luò)拓?fù)浣Y(jié)構(gòu)15-18
- 2.2 片上網(wǎng)絡(luò)中常見(jiàn)問(wèn)題18-19
- 2.2.1 死鎖19
- 2.2.2 活鎖19
- 2.3 片上網(wǎng)絡(luò)路由器通用架構(gòu)19-21
- 2.4 本章小結(jié)21-23
- 第三章 片上網(wǎng)絡(luò)路由器方案設(shè)計(jì)23-39
- 3.1 數(shù)據(jù)傳輸方案設(shè)計(jì)23-27
- 3.1.1 交換機(jī)制23-24
- 3.1.2 虛通道技術(shù)24-26
- 3.1.3 流控機(jī)制26-27
- 3.2 網(wǎng)絡(luò)接口方案設(shè)計(jì)27-30
- 3.2.1 計(jì)算單元傳輸協(xié)議27-28
- 3.2.2 路由器傳輸協(xié)議28-29
- 3.2.3 網(wǎng)絡(luò)接口功能29-30
- 3.3 路由方案設(shè)計(jì)30-34
- 3.3.1 Lookahead路由技術(shù)30-31
- 3.3.2 路由算法設(shè)計(jì)31-34
- 3.4 通道分配方案設(shè)計(jì)34-38
- 3.4.1 虛通道分配34-36
- 3.4.2 開(kāi)關(guān)分配36-38
- 3.5 本章小結(jié)38-39
- 第四章 片上網(wǎng)絡(luò)路由器的硬件實(shí)現(xiàn)39-59
- 4.1 路由器整體設(shè)計(jì)39-40
- 4.2 網(wǎng)絡(luò)接口模塊設(shè)計(jì)40-45
- 4.2.1 網(wǎng)絡(luò)接口寫操作模塊設(shè)計(jì)41-42
- 4.2.2 網(wǎng)絡(luò)接口數(shù)據(jù)搬移模塊設(shè)計(jì)42-44
- 4.2.3 網(wǎng)絡(luò)接口解包模塊設(shè)計(jì)44-45
- 4.3 輸入模塊的設(shè)計(jì)45-51
- 4.3.1 輸入控制模塊46-48
- 4.3.2 路由計(jì)算模塊48-49
- 4.3.3 緩存模塊49-51
- 4.4 分配器模塊的設(shè)計(jì)51-56
- 4.4.1 矩陣對(duì)角線虛通道分配器設(shè)計(jì)51-53
- 4.4.2 矩陣對(duì)角線開(kāi)關(guān)分配器設(shè)計(jì)53-54
- 4.4.3 矩陣對(duì)角線分配器仲裁機(jī)制的公平性研究54-56
- 4.5 交叉開(kāi)關(guān)模塊的設(shè)計(jì)56-57
- 4.5.1 多路復(fù)用交叉開(kāi)關(guān)56-57
- 4.5.2 三態(tài)門交叉開(kāi)關(guān)57
- 4.6 輸出模塊的設(shè)計(jì)57-58
- 4.7 本章小結(jié)58-59
- 第五章 仿真及驗(yàn)證59-81
- 5.1 功能驗(yàn)證概述59-60
- 5.2 模塊級(jí)功能驗(yàn)證60-67
- 5.2.1 網(wǎng)絡(luò)接口功能驗(yàn)證60-62
- 5.2.2 輸入模塊功能驗(yàn)證62-65
- 5.2.3 虛通道分配器功能驗(yàn)證65-66
- 5.2.4 開(kāi)關(guān)分配器功能驗(yàn)證66-67
- 5.3 整體功能仿真67-69
- 5.3.1 單個(gè)數(shù)據(jù)包傳輸仿真67-68
- 5.3.2 多個(gè)數(shù)據(jù)包傳輸仿真68-69
- 5.4 DC綜合69-70
- 5.5 FPGA驗(yàn)證70-75
- 5.5.1 FPGA測(cè)試結(jié)果70-71
- 5.5.2 FPGA板級(jí)驗(yàn)證71-75
- 5.6 性能分析75-79
- 5.6.1 吞吐率76-77
- 5.6.2 數(shù)據(jù)包延時(shí)77-78
- 5.6.3 分配器匹配率78-79
- 5.7 本章小結(jié)79-81
- 第六章 總結(jié)與展望81-83
- 6.1 總結(jié)81
- 6.2 展望81-83
- 參考文獻(xiàn)83-87
- 致謝87-89
- 攻讀碩士學(xué)位期間的成果89
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