發(fā)布時間：2019-01-17 12:43

【摘要】：USB3. 0是一種由Intel和Microsoft公司發(fā)起創(chuàng)立的接口規(guī)范,它以USB2. 0作為基礎實現了接口技術的進一步發(fā)展。USB2.0的最大傳輸帶寬為480Mbps,而USB3. 0將帶寬提高到了 5Gbps,它比USB2. 0更適合傳輸海量數據文件。USB3. 0比USB2. 0的傳輸效率高、功耗更低,特別地加強了電源管理功能,并且USB3.0向下兼容USB2.0,方便USB2.0接口產品的升級。USB3.0接口在未來一定會被普遍地應用于電子產品中。本文主要是按照USB3. 0協(xié)議的要求設計USB3. 0物理層中的擾碼及解擾碼電路。USB3.0物理層可分為數字電路模塊與模擬電路模塊,其中數字電路模塊主要由擾碼及解擾碼電路,8b/1Ob編解碼電路,K28. 5檢測模塊,彈性緩沖器模塊,串并及并串轉換電路等模塊構成。擾碼及解擾碼電路是USB3. 0物理層數據處理流程中的重要部分,且它與物理層中的8b/10b編解碼電路模塊相互聯(lián)系。因此,本文對8b/10b編解碼模塊也進行研究與設計。論文在分析了 USB3. 0協(xié)議中擾碼及解擾碼的原理與規(guī)則后,提出以8位并行方法來實現USB3. 0物理層中的擾碼與解擾碼電路。本文使用FPGA驗證電路邏輯功能,運用Verilog硬件語言描述擾碼及解擾碼電路,再通過Modelsim仿真軟件進行功能上的仿真。結果表明所設計出來的擾碼及解碼電路滿足USB3. 0數據通信協(xié)議要求。
[Abstract]:USB3. 0 is an interface specification initiated by Intel and Microsoft, which is based on USB2. The maximum transmission bandwidth of USB2.0 is 480 Mbpss, while that of USB3. is 480 Mbpss. 0 increases the bandwidth to 5 GB pss, which is higher than USB2. 0 is more suitable for transferring massive data files. USB3. 0 ratio USB2. 0 has high transmission efficiency and low power consumption, especially enhanced power management, and USB3.0 is compatible with USB2.0, downwards to facilitate the upgrade of USB2.0 interface products. USB3.0 interface will be widely used in electronic products in the future. This article is mainly based on the USB3. Design USB3. for 0. 0 protocol The physical layer of USB3.0 can be divided into digital circuit module and analog circuit module, in which the digital circuit module mainly consists of scrambling code and descrambling circuit, 8b/1Ob encoding and decoding circuit, K28. Detection module, elastic buffer module, series-parallel and parallel conversion circuit and other modules. Scrambling and unscrambling circuit is USB3. 0 is an important part of the physical layer data processing flow, and it is related to the 8b/10b codec circuit module in the physical layer. Therefore, this paper also carries on the research and the design to the 8b/10b codec module. The paper analyzes the USB3. After the principle and rule of scrambling code and unscrambling code in 0 protocol, an 8-bit parallel method is proposed to implement USB3.. The scrambling code and descrambling circuit in the physical layer. In this paper, the logic function of the circuit is verified by FPGA, and the scrambling code and unscrambling circuit are described by Verilog hardware language, and the functional simulation is carried out by Modelsim simulation software. The results show that the scrambling code and decoding circuit can satisfy USB3.. Data communication protocol requirements.
【學位授予單位】：合肥工業(yè)大學
【學位級別】：碩士
【學位授予年份】：2017
【分類號】：TN791;TP334.7

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本文編號：2410074