本文選題：射頻識(shí)別(RFID)標(biāo)簽 + 數(shù)字基帶��； 參考：《半導(dǎo)體技術(shù)》2017年04期

【摘要】：提出了一種符合ISO/IEC 18000-6C協(xié)議中關(guān)于時(shí)序規(guī)定的射頻識(shí)別(RFID)無源標(biāo)簽芯片低功耗數(shù)字基帶處理器的設(shè)計(jì)�；诓捎媚M前端反向散射鏈路頻率(BLF)時(shí)鐘的方案,將BLF的二倍頻設(shè)置為基帶中的全局時(shí)鐘,構(gòu)建BLF和基帶數(shù)據(jù)處理速率之間的聯(lián)系;同時(shí)在設(shè)計(jì)中采用門控時(shí)鐘和行波計(jì)數(shù)器代替?zhèn)鹘y(tǒng)計(jì)數(shù)器等低功耗策略。芯片經(jīng)TSMC 0.18μm CMOS混合信號(hào)工藝流片,實(shí)測結(jié)果表明,采用該設(shè)計(jì)的標(biāo)簽最遠(yuǎn)識(shí)別距離為7 m,數(shù)字基帶動(dòng)態(tài)功耗明顯降低,且更加符合RFID協(xié)議的要求。
[Abstract]:A low power digital baseband processor for radio frequency identification (RFID) passive tag chip in accordance with ISO/IEC 18000-6C protocol is proposed. Based on the scheme of analog front-end backscatter link frequency (BLF) clock, the double frequency of BLF is set as the global clock in baseband, and the relation between BLF and baseband data processing rate is constructed. At the same time, the gating clock and traveling wave counter are used to replace the traditional counter in the design. The chip is processed by TSMC 0.18 渭 m CMOS mixed signal technology. The measured results show that the maximum recognition distance of the label is 7 m, and the dynamic power consumption of digital baseband is obviously reduced, which is more in line with the requirements of RFID protocol.
【作者單位】： 西藏民族大學(xué)信息工程學(xué)院;西藏光信息處理與可視化技術(shù)重點(diǎn)實(shí)驗(yàn)室;西安電子科技大學(xué)微電子學(xué)院寬禁帶半導(dǎo)體材料與器件重點(diǎn)實(shí)驗(yàn)室;
【基金】：西藏高校青年教師創(chuàng)新支持計(jì)劃資助項(xiàng)目(QC2015-60)
【分類號(hào)】：TP391.44;TN402

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本文編號(hào)：1775302