本文選題：逐次逼近 + 模數(shù)轉(zhuǎn)換器��； 參考：《河北大學》2015年碩士論文

【摘要】：PCM語音編解碼芯片能夠?qū)崿F(xiàn)模擬語音信號的數(shù)字化和重構,其低功耗、小型化的封裝形式在移動終端市場有很大的需求量。A/D轉(zhuǎn)換器是將模擬信號轉(zhuǎn)換成相應的數(shù)字信號,其作為模擬信號和數(shù)字電路的接口,是PCM語音編解碼芯片中不可或缺的重要模塊。在中等速度、中等精度的A/D轉(zhuǎn)換器中,逐次逼近型模數(shù)轉(zhuǎn)換器(SAR ADC)應用比較廣泛,其速度、精度、功耗和成本方面比其他種類轉(zhuǎn)換器在該領域應用中占據(jù)優(yōu)勢。本文主要研究設計應用于一款PCM語音編解碼芯片中的SAR ADC,結合PCM編解碼原理及編碼規(guī)則詳細分析了這種ADC的工作原理。在具體電路的設計過程中,DAC電路采用電荷與電壓混合按比例縮放型結構,其中MSB位由分段電容網(wǎng)絡來實現(xiàn),分段式電容陣列結構不僅轉(zhuǎn)換速度比較快,而且電容相對于溫度變化不敏感,穩(wěn)定性更強。LSB位采用電壓按比例縮放結構,該結構用于確定PCM編碼中的段內(nèi)碼,為了保證段內(nèi)碼的單調(diào),采用電阻陣列來實現(xiàn)。對于比較器的設計,采用運放結構和數(shù)字電路共同來實現(xiàn),使設計相對簡單,同時有效地提高了比較器的工作速度和分辨率。本文采用0.35μm CMOS工藝,基于Cadence平臺,采用數(shù)�；旌戏抡娴姆椒▽φw電路進行了仿真分析。結果表明,在8k Hz采樣頻率下,對于240Hz的正弦信號,設計的SAR ADC信噪比SNR為47.4 d B,無摻雜動態(tài)范圍SFDR為49.3 d B,有效位數(shù)為7.58 bit,滿足預期的設計要求。
[Abstract]:An analog - to - digital converter ( SAR ADC ) is widely used in PCM speech coding and decoding chip .

【學位授予單位】：河北大學
【學位級別】：碩士
【學位授予年份】：2015
【分類號】：TN792

【參考文獻】

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本文編號：1734391