本文選題：LDPC　切入點(diǎn)：動態(tài)配置　出處：《微電子學(xué)與計算機(jī)》2017年04期

【摘要】：為了實現(xiàn)大數(shù)據(jù)時代以固態(tài)硬盤為代表的大容量高吞吐率存儲器的糾錯編碼,基于數(shù)學(xué)特性優(yōu)異的LDPC碼,提出了一種半并行的LDPC編碼器架構(gòu).采用SIMD指令的調(diào)度控制流方式實現(xiàn)了RU編碼算法,完成了碼率和碼長等參數(shù)可動態(tài)配置的LDPC編碼器的電路設(shè)計.通過Matlab與ModelSim聯(lián)合仿真,并在Xilinx FPGA平臺上驗證了編碼器的功能正確性.結(jié)果表明:工作頻率為100 MHz時,配置時間少于7μs且相對于其它編碼器結(jié)構(gòu)可以在較少的資源下吞吐率可達(dá)4.82Gb/s.
[Abstract]:In order to error correction encoding high throughput memory capacity to achieve big data era with SSD as the representative, based on the mathematical characteristics of excellent LDPC code, this paper proposes a kind of semi parallel LDPC encoder architecture. Flow using SIMD commands to control the realization of the RU encoding algorithm, finished the circuit design parameters of rate and length can LDPC encoder dynamic configuration. Through the joint simulation of Matlab and ModelSim, and verify the functional correctness of Xilinx encoder in FPGA platform. The results show that the working frequency is 100 MHz, the configuration time of less than 7 Mu s and relative to the can in less resources under the throughput of other 4.82Gb/s. encoder structure

【作者單位】： 清華大學(xué)微電子學(xué)研究所;全球能源互聯(lián)網(wǎng)研究院信息與通信研究所;
【基金】：國家電網(wǎng)公司科技項目(SGRIDGKJ[2013]209號)
【分類號】：TN762

【參考文獻(xiàn)】

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【共引文獻(xiàn)】

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【相似文獻(xiàn)】

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本文編號：1703117