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高速串行總線過孔結(jié)構(gòu)優(yōu)化及設(shè)計與仿真協(xié)同流程

發(fā)布時間:2018-03-24 00:37

  本文選題:高速串行設(shè)計 切入點:過孔 出處:《電子技術(shù)應(yīng)用》2017年08期


【摘要】:56 G PAM4已經(jīng)是近年來高速串行總線設(shè)計的新熱點,同時行業(yè)也開始關(guān)注56 G NRZ和112 G PAM4的實現(xiàn)。速率提升帶來了通道設(shè)計的挑戰(zhàn),尤其是過孔結(jié)構(gòu)的優(yōu)化,是無源通道性能的關(guān)鍵指標(biāo)。從兩方面來介紹過孔結(jié)構(gòu)優(yōu)化,首先討論如何確保優(yōu)化的準(zhǔn)確性,如何通過仿真測試校準(zhǔn)的方法流程得到準(zhǔn)確的過孔結(jié)構(gòu)的S參數(shù),準(zhǔn)確的仿真是優(yōu)化過孔結(jié)構(gòu)的前提。在對測試結(jié)果校準(zhǔn)的基礎(chǔ)上討論如何進(jìn)行準(zhǔn)確的過孔仿真,對比不同優(yōu)化方式的結(jié)果及影響。同時,關(guān)注Cadence Sigrity新的HSSO(High Speed Structure Optimizer)工具及流程,提升了設(shè)計及仿真優(yōu)化的效率,更重要的是提升了設(shè)計與仿真之間溝通的效率,并減少溝通不暢帶來的質(zhì)量問題。
[Abstract]:56G PAM4 has been a new hot spot in the design of high-speed serial bus in recent years. At the same time, the industry has begun to pay attention to the realization of 56G NRZ and 112G PAM4. This paper introduces the optimization of perforated structure from two aspects. Firstly, it discusses how to ensure the accuracy of the optimization, and how to obtain the accurate S parameters of the perforated structure through the flow of simulation test and calibration. Accurate simulation is the premise of optimizing the structure of perforation. On the basis of calibrating the test results, this paper discusses how to carry out accurate simulation of perforation, and compares the results and effects of different optimization methods. At the same time, it pays close attention to the new HSSO(High Speed Structure optimizer tool and flow chart of Cadence Sigrity. It improves the efficiency of design and simulation optimization and, more importantly, improves the efficiency of communication between design and simulation, and reduces the quality problems caused by poor communication.
【作者單位】: 深圳市一博科技有限公司;Cadence深圳分公司;
【分類號】:TN41;TP391.9

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2 周榮;孟憲元;;FPGA實現(xiàn)高速串行總線(GCZ)[A];圖像 仿真 信息技術(shù)——第二屆聯(lián)合學(xué)術(shù)會議論文集[C];2002年

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8 李燕;IEEE 1394高速串行總線及其在Windows下演示系統(tǒng)的研制[D];中國科學(xué)院研究生院(空間科學(xué)與應(yīng)用研究中心);2002年



本文編號:1655952

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