本文關(guān)鍵詞： 環(huán)形振蕩器 偽差分兩級(jí)環(huán)形振蕩 相位噪聲　出處：《微電子學(xué)》2017年05期 　論文類(lèi)型：期刊論文

【摘要】：設(shè)計(jì)了一種偽差分兩級(jí)環(huán)形振蕩器,可為鎖相環(huán)提供8GHz四相位正交時(shí)鐘。通過(guò)分析耦合兩級(jí)環(huán)形振蕩線性模型,對(duì)四級(jí)環(huán)形振蕩結(jié)構(gòu)進(jìn)行優(yōu)化,提出了偽差分兩級(jí)環(huán)形振蕩結(jié)構(gòu)�；趩渭�(jí)緩沖器的開(kāi)環(huán)分析,可對(duì)振蕩器的輸出頻率進(jìn)行精準(zhǔn)估算,并判斷振蕩情況。采用65nm CMOS工藝進(jìn)行設(shè)計(jì)與仿真。結(jié)果表明,在1.2V電壓下,振蕩器的功耗為6.9mW,1 MHz頻率處的相位噪聲為-82.104 5dB,滿(mǎn)足高速SerDes接口的設(shè)計(jì)要求。
[Abstract]:A pseudo-differential two-stage ring oscillator is designed, which can provide an 8GHz four-phase quadrature clock for the phase-locked loop. By analyzing the coupled two-stage ring oscillation linear model, the four-stage ring oscillation structure is optimized. Based on the open-loop analysis of single-stage buffer, the output frequency of the oscillator can be accurately estimated. The results show that the power consumption of the oscillator is 6.9 MW at 1.2V voltage. 1 the phase noise at MHz frequency is -82.1045 dB, which meets the design requirements of high-speed SerDes interface.
【作者單位】： 國(guó)防科學(xué)技術(shù)大學(xué)計(jì)算機(jī)學(xué)院;
【基金】：國(guó)家自然科學(xué)基金資助項(xiàng)目(61133007,61402505)
【分類(lèi)號(hào)】：TN752
【正文快照】： 0引言壓控振蕩器是時(shí)鐘恢復(fù)電路中鎖相環(huán)的核心電路。與LC振蕩器相比,RC環(huán)形振蕩器具有頻率調(diào)節(jié)范圍大、芯片面積小的特點(diǎn),并且隨著工藝的不斷進(jìn)步,基于CMOS反相器結(jié)構(gòu)的環(huán)形振蕩器在性能上具有較大的提升空間[1]。振蕩器作為一個(gè)非線性的反饋系統(tǒng),要產(chǎn)生穩(wěn)定的振蕩,需滿(mǎn)足兩

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本文編號(hào)：1472187