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針對(duì)路徑故障與局部擁塞的NoC容錯(cuò)路由算法

發(fā)布時(shí)間:2018-01-10 04:03

  本文關(guān)鍵詞:針對(duì)路徑故障與局部擁塞的NoC容錯(cuò)路由算法 出處:《電子學(xué)報(bào)》2016年04期  論文類型:期刊論文


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【摘要】:片上網(wǎng)絡(luò)作為一種新型片上互連架構(gòu),克服了片上系統(tǒng)在發(fā)展中遭遇的瓶頸問(wèn)題.然而,片上網(wǎng)絡(luò)中的路由器故障以及路由器之間的鏈路故障都會(huì)造成網(wǎng)絡(luò)性能損失.對(duì)此,文章提出一種針對(duì)路徑故障與局部擁塞的No C容錯(cuò)路由算法.首先,設(shè)計(jì)了一種相隔節(jié)點(diǎn)間路徑故障模型,該模型下的路由器以較小的開銷為代價(jià),動(dòng)態(tài)感知兩跳以內(nèi)的路徑故障狀態(tài).其次,提出了一種新穎的更能準(zhǔn)確反映局部網(wǎng)絡(luò)擁塞狀態(tài)的擁塞模型來(lái)均衡網(wǎng)絡(luò)流量.最后,當(dāng)網(wǎng)絡(luò)無(wú)故障時(shí),算法保證走最優(yōu)路徑;有故障時(shí),算法不僅可以實(shí)現(xiàn)容錯(cuò)還能保證網(wǎng)絡(luò)具有良好的性能.實(shí)驗(yàn)表明,在無(wú)故障的情況下,本文方案相較于對(duì)比對(duì)象延遲降低了10%~20%,吞吐率提高了25%左右.在有故障的情況下,本文方案較對(duì)比對(duì)象的優(yōu)勢(shì)更加明顯.
[Abstract]:As a new type of on-chip interconnection architecture, the on-chip network overcomes the bottleneck problem encountered in the development of on-chip system. Router failures in on-chip networks and link failures between routers can cause network performance losses. In this paper, a fault-tolerant routing algorithm for path failures and local congestion is proposed in this paper. First of all, no C fault-tolerant routing algorithm is proposed. A path fault model between nodes is designed, in which routers dynamically perceive the path fault state within two hops at the cost of less overhead. A novel congestion model which can accurately reflect the congestion state of local networks is proposed to balance the network traffic. Finally, when the network is faultless, the algorithm guarantees the optimal path. When there is a fault, the algorithm can not only achieve fault tolerance, but also ensure the network has good performance. Experiments show that, compared with the contrast object delay, the proposed scheme reduces 10% or 20% in the case of no fault. The throughput is increased by about 25%. In the case of failure, the advantage of this scheme is more obvious than that of the object.
【作者單位】: 合肥工業(yè)大學(xué)計(jì)算機(jī)與信息學(xué)院;合肥工業(yè)大學(xué)電子科學(xué)與應(yīng)用物理學(xué)院;
【基金】:國(guó)家自然科學(xué)基金(No.61474036,No.61274036,No.61371025) 安徽省自然科學(xué)基金(No.1508085MF117)
【分類號(hào)】:TN47
【正文快照】: 1引言隨著單個(gè)芯片上集成的核越來(lái)越多,多核以及眾核系統(tǒng)中同時(shí)有超過(guò)一個(gè)任務(wù)在執(zhí)行的可能性也越來(lái)越大.這就使得單任務(wù)執(zhí)行的片上系統(tǒng)(System-on-Chip,So C)在發(fā)展過(guò)程中遭遇瓶頸.鑒于此,有研究者提出通過(guò)借鑒計(jì)算機(jī)網(wǎng)絡(luò)和并行計(jì)算技術(shù)設(shè)計(jì)另一種新穎的片上互連架構(gòu)——片上

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8 洪佳潔;高性能低功耗片上網(wǎng)絡(luò)設(shè)計(jì)中的功耗與延時(shí)模型研究[D];南京航空航天大學(xué);2010年

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本文編號(hào):1403745

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