發(fā)布時間：2017-11-07 06:00

  本文關鍵詞：一種低資源消耗的物理不可克隆函數FPGA設計

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【摘要】：針對傳統(tǒng)仲裁器物理不可克隆函數(PUF)在FPGA上實現后唯一性很差,而且資源消耗代價大的問題,在分析FPGA Slice的結構基礎上,設計了一種新型結構的仲裁器PUF電路,該電路大幅度地提高了唯一性,大大減少了FPGA的資源消耗,使得仲裁器PUF可應用于FPGA.基于此提出了一種對傳統(tǒng)仲裁器PUF結構改進的方案,利用Slice之間的對稱性來提升PUF的唯一性,并充分利用Slice內部的組合邏輯資源以降低資源消耗.實驗測量了片間海明距離和片內海明距離,評估了64bit的仲裁器PUF電路的唯一性和穩(wěn)定性,結果表明:改進后的仲裁器PUF非常適合在FPGA上實現,能夠降低62.5%的資源消耗,并且唯一性比較接近理想值.
【作者單位】： 華中科技大學光學與電子信息學院;
【基金】：國家自然科學資金資助項目(61376026;61202469)
【分類號】：TN791
【正文快照】： 仲裁器物理不可克隆函數[1-2]是物理不可克隆函數(PUF)[3]在硅上的一種實現形式,人們還提出過許多不同形式的PUF.盡管PUF形式不同,但都可以利用器件的制造工藝偏差而產生的物理隨機性,提取出與該物體唯一相關的特征量.通過該特征量,可以唯一識別對應的物體,而且該特征量無法被

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本文編號：1151119