隨著網絡通信技術的發(fā)展,對數(shù)據(jù)的傳輸速度提出了更高的要求,根據(jù)不同的需求提出了各種各樣的通信協(xié)議。使用不同協(xié)議的設備之間互相通信的需求越來越大,因此,需要設計一些專用的協(xié)議轉換設備來達到這個目的。該課題基于FPGA設計了萬兆協(xié)議轉換系統(tǒng),實現(xiàn)了標準以太網協(xié)議和專用鏈路協(xié)議之間的轉換。分析了具體的設計要求后給出了對應的工程實現(xiàn)方法,具體工作包括以下幾個方面:1)研究以太網標準通信協(xié)議,通過Xilinx公司以太網IP核結合FPGA內部邏輯設計以太網接口接收與發(fā)送控制器,實現(xiàn)對千兆以太網低速數(shù)據(jù)和萬兆以太網高速數(shù)據(jù)的收發(fā);2)研究系統(tǒng)專用鏈路協(xié)議,通過FPGA內部邏輯設計協(xié)議轉換器,實現(xiàn)對高低速數(shù)據(jù)的復接/分接功能,同時實現(xiàn)標準以太網協(xié)議和專用鏈路協(xié)議之間的轉換;3)研究高速串行傳輸技術,通過Xilinx公司Aurora IP核結合FPGA內部邏輯設計基于Aurora協(xié)議的高速串行通信控制器,實現(xiàn)10Gbps級別的數(shù)據(jù)傳輸速率;4)為了確保對高速數(shù)據(jù)處理的高效性和實時性,通過Xilinx公司FIFO IP核結合FPGA內部邏輯設計數(shù)據(jù)緩存處理器,實現(xiàn)對10Gbps級數(shù)據(jù)的緩存和處理。對各個模... 

【文章來源】：河北科技大學河北省

【文章頁數(shù)】：68 頁

【學位級別】：碩士

【部分圖文】：

Aurora協(xié)議應用舉例

11圖 3-1 系統(tǒng)總體硬件結構框圖本系統(tǒng)要實現(xiàn) 4 路通道的協(xié)議轉換功能，由于芯片資源等各方面因素，硬件平臺要分為兩部分，兩塊核心板，每一塊核心板以及外圍的硬件組成等是完全一樣的實現(xiàn)的功能也是相同的，所以在以下描述中只針對第一部分來說明。本課題基于FPGA 來實現(xiàn)，主要實現(xiàn)的功能是完成標準以太網協(xié)議與自定義專用鏈路協(xié)議之間的轉換，輸入端主要包括千兆以太網數(shù)據(jù)（低速數(shù)據(jù)）和萬兆以太網數(shù)據(jù)（高速數(shù)據(jù)）

t 發(fā)送數(shù)據(jù)錯誤提示信號t 發(fā)送數(shù)據(jù)參考時鐘8bit 接收端數(shù)據(jù)接收使能信號，在此信號有效期內傳輸數(shù)據(jù)才有接收數(shù)據(jù)錯誤提示信號接收數(shù)據(jù)參考時鐘模塊電路設計的核心器件是 10G 光模塊，它的封裝形式為號之間的相互轉換，內部通過萬兆以太網模口相連接，既與 FPGA 中的 BANK118 連接塊G 光模塊使用 FINISAR 公司 74441-0010 型號

【參考文獻】：
期刊論文
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碩士論文
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本文編號：3511775