本文選題：信息安全 + 國密SM�。� 參考：《電子器件》2017年03期

【摘要】：為滿足網(wǎng)絡安全認證的需求,提出了一種高吞吐率的國密SM3的硬件IP核的設計方法。該方法用3級流水線縮短了每輪運算的關鍵路徑,提升了系統(tǒng)時鐘,并將64輪運算全部展開,實現(xiàn)輪間64級流水線,總共192級的全流水線設計,能夠同時實現(xiàn)192組消息的SM3運算。基于SMIC 0.18μm的工藝,實現(xiàn)了該IP核,時鐘頻率達到了200 MHz,吞吐率達到了102.4 Gbit/s,比現(xiàn)有的研究成果提升39.3%。
[Abstract]:In order to meet the requirement of network security authentication, a design method of hardware IP core of Guomai SM3 with high throughput is proposed.In this method, the critical path of each operation is shortened by pipeline of level 3, the system clock is raised, and 64 rounds of operation are fully expanded to realize the design of a complete pipeline with a total of 192 levels.The SM3 operation of 192 groups of messages can be implemented at the same time.Based on the SMIC 0.18 渭 m process, the IP core is realized. The clock frequency reaches 200MHz and the throughput reaches 102.4 Gbit / s, which is 39.3% higher than the existing research results.
【作者單位】： 貴陽學院電子與通信工程學院;安全互聯(lián)實驗室;
【基金】：國家自然科學基金青年項目(11605030) 貴州省聯(lián)合基金項目(黔科合J字LKG[2013]40號);貴州省聯(lián)合基金項目(黔科合J字LKG[2013]41號)
【分類號】：TP393.08

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