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輻射計射頻干擾時頻域檢測系統(tǒng)設(shè)計及實現(xiàn)

發(fā)布時間:2017-10-17 02:04

  本文關(guān)鍵詞:輻射計射頻干擾時頻域檢測系統(tǒng)設(shè)計及實現(xiàn)


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【摘要】:隨著電磁環(huán)境的不斷惡化,射頻干擾已經(jīng)成為提高微波輻射計探測精度的最大障礙,開展射頻干擾檢測研究具有重要意義。針對輻射計射頻干擾檢測需求,本文研究了基于時頻域的射頻干擾檢測算法,設(shè)計并實現(xiàn)了輻射計射頻干擾時頻域檢測系統(tǒng),并對系統(tǒng)進行了實驗驗證。首先,本文對輻射計射頻干擾時頻域檢測方法進行了研究。在介紹了峰度檢測算法和能量檢測算法的基礎(chǔ)上,分析了峰度檢測在恒虛警下對不同信噪比和占空比射頻干擾的檢測性能。在闡述了小波包分解在時頻域分析中的重要作用后,給出了峰度-小波包和能量-小波包兩種基于時頻域的射頻干擾檢測算法,并通過Matlab仿真研究了兩種算法對不同信噪比和占空比射頻干擾的檢測性能。其次,設(shè)計了輻射計射頻干擾時頻域檢測系統(tǒng)的硬件。具體包括ADC采集電路、時鐘發(fā)生器電路、FPGA核心電路、DSP核心電路、串口和以太網(wǎng)通信電路、電源電路、DDR2和NAND FLASH存儲電路以及FPGA和DSP通信接口電路,并闡述了硬件電路PCB設(shè)計中需要注意的問題。再次,設(shè)計了輻射計射頻干擾時頻域檢測系統(tǒng)的軟件。具體包括時鐘發(fā)生器控制模塊、ADC控制模塊、FIR濾波器、FPGA和DSP的uPP接口模塊、以太網(wǎng)和串口通信模塊。實現(xiàn)了時頻域射頻干擾檢測算法在DSP中的移植,并進行了實驗驗證。最后,先對輻射計射頻干擾時頻域檢測系統(tǒng)進行了系統(tǒng)測試,對時鐘發(fā)生器、ADC芯片、uPP接口、DDR2存儲器進行了功能驗證。然后對輻射計射頻干擾時頻域檢測系統(tǒng)進行了模擬實驗。實驗結(jié)果表明,時頻域射頻干擾檢測算法可有效實現(xiàn)射頻干擾檢測,并驗證了輻射計射頻干擾時頻域檢測系統(tǒng)的正確性。
【關(guān)鍵詞】:輻射計 射頻干擾檢測 時頻域 DSP
【學(xué)位授予單位】:南京理工大學(xué)
【學(xué)位級別】:碩士
【學(xué)位授予年份】:2016
【分類號】:TP73
【目錄】:
  • 摘要3-4
  • Abstract4-8
  • 1 緒論8-13
  • 1.1 課題研究背景和意義8-9
  • 1.2 國內(nèi)外研究現(xiàn)狀9-11
  • 1.3 本文的主要工作11-13
  • 2 輻射計射頻干擾時頻域檢測方法研究13-29
  • 2.1 輻射計基本原理13
  • 2.2 峰度檢測算法研究13-19
  • 2.2.1 基本數(shù)學(xué)概念13-15
  • 2.2.2 峰度檢測信號建模15-16
  • 2.2.3 峰度檢測算法理論16-19
  • 2.3 能量檢測算法研究19-20
  • 2.4 時頻域射頻干擾檢測算法研究20-28
  • 2.4.1 小波包變換20-22
  • 2.4.2 峰度檢測門限22-24
  • 2.4.3 峰度-小波包和能量-小波包檢測算法24-28
  • 2.5 本章小結(jié)28-29
  • 3 輻射計射頻干擾時頻域檢測系統(tǒng)硬件設(shè)計29-51
  • 3.1 硬件總體方案設(shè)計29-30
  • 3.2 FPGA模塊硬件電路設(shè)計30-38
  • 3.2.1 ADC采集模塊電路設(shè)計30-32
  • 3.2.2 時鐘發(fā)生器模塊電路設(shè)計32-33
  • 3.2.3 FPGA核心電路設(shè)計33-35
  • 3.2.4 電源模塊電路設(shè)計35-38
  • 3.3 DSP模塊硬件電路設(shè)計38-47
  • 3.3.1 DSP核心電路設(shè)計38-40
  • 3.3.2 通信模塊電路設(shè)計40-42
  • 3.3.3 電源模塊設(shè)計42-43
  • 3.3.4 復(fù)位電路設(shè)計43-44
  • 3.3.5 存儲器模塊及BOOT模式設(shè)計44-47
  • 3.4 FPGA與DSP通信模塊設(shè)計47-48
  • 3.5 硬件電路PCB設(shè)計48-50
  • 3.5.1 PCB疊層設(shè)計49
  • 3.5.2 PCB設(shè)計中的信號完整性49-50
  • 3.6 本章小結(jié)50-51
  • 4 輻射計射頻干擾時頻域檢測系統(tǒng)軟件設(shè)計51-64
  • 4.1 FPGA軟件設(shè)計51-56
  • 4.1.1 CDCE62005控制模塊51-53
  • 4.1.2 ADS6128控制模塊53-54
  • 4.1.3 FIR濾波器模塊54-56
  • 4.2 uPP接口控制設(shè)計56-57
  • 4.3 DSP的軟件設(shè)計57-60
  • 4.3.1 DSP軟件流程57-58
  • 4.3.2 uPP接口軟件設(shè)計58-59
  • 4.3.3 以太網(wǎng)和串口軟件設(shè)計59-60
  • 4.4 射頻干擾時頻域檢測算法的DSP實現(xiàn)60-63
  • 4.5 本章小結(jié)63-64
  • 5 輻射計射頻干擾時頻域檢測系統(tǒng)驗證64-72
  • 5.1 輻射計射頻干擾時頻域檢測系統(tǒng)測試64-67
  • 5.1.1 時鐘發(fā)生器測試64
  • 5.1.2 ADC測試64-65
  • 5.1.3 uPP接口測試65-66
  • 5.1.4 DDR2存儲器測試66-67
  • 5.2 輻射計射頻干擾時頻域檢測系統(tǒng)模擬實驗67-71
  • 5.2.1 測試信號的產(chǎn)生67-68
  • 5.2.2 實驗環(huán)境及參數(shù)68-69
  • 5.2.3 實驗結(jié)果69-71
  • 5.3 本章小結(jié)71-72
  • 6 總結(jié)與展望72-74
  • 6.1 總結(jié)72
  • 6.2 展望72-74
  • 致謝74-75
  • 參考文獻75-79
  • 附錄A79-81
  • 附錄B81

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本文編號:1046149

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