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基于NIOSⅡ的濾光器波帶運(yùn)動(dòng)控制系統(tǒng)設(shè)計(jì)

發(fā)布時(shí)間:2017-10-03 12:34

  本文關(guān)鍵詞:基于NIOSⅡ的濾光器波帶運(yùn)動(dòng)控制系統(tǒng)設(shè)計(jì)


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【摘要】:濾光器是太陽(yáng)磁場(chǎng)觀測(cè)儀器的重要組成部分,實(shí)現(xiàn)濾光器波帶快速準(zhǔn)確地調(diào)整是構(gòu)建電控系統(tǒng)過(guò)程中的基礎(chǔ)工作之一,對(duì)簡(jiǎn)化觀測(cè)步驟、提高系統(tǒng)整體性能有著重要的意義。論文采用靈活度較高的NIOS Ⅱ處理器,設(shè)計(jì)并實(shí)現(xiàn)了一套全新的濾光器波帶控制系統(tǒng)——包括硬件平臺(tái)、驅(qū)動(dòng)程序和控制程序以及用戶調(diào)試界面。硬件平臺(tái)設(shè)計(jì)包括了底層功能模塊硬件電路設(shè)計(jì)及FPGA平臺(tái)設(shè)計(jì)兩方面,電路設(shè)計(jì)涵蓋了芯片選型、方案對(duì)比以及PCB制作等內(nèi)容。研究中提出了基于FRAM芯片的存儲(chǔ)模塊設(shè)計(jì)方案,解決了電機(jī)位置數(shù)據(jù)掉電丟失的問(wèn)題,在一定程度上提升了系統(tǒng)運(yùn)動(dòng)的安全性,是論文研究的重點(diǎn)之一。論文選用C作為程序的設(shè)計(jì)語(yǔ)言,在設(shè)計(jì)過(guò)程中參照各知識(shí)產(chǎn)權(quán)核寄存器結(jié)構(gòu),并結(jié)合由Altera公司提供的HAL庫(kù)函數(shù),實(shí)現(xiàn)了對(duì)底層電路的具體控制。該部分主要完成了通信和存儲(chǔ)模塊的驅(qū)動(dòng)程序設(shè)計(jì)工作,相對(duì)運(yùn)動(dòng)、絕對(duì)運(yùn)動(dòng)等11個(gè)具體控制程序編寫工作。最終實(shí)現(xiàn)了波帶運(yùn)動(dòng)控制系統(tǒng)的全部功能,并將電機(jī)控制數(shù)目提升至12個(gè)。用戶界面設(shè)計(jì)使用了由微軟公司提供的MFC庫(kù)類,根據(jù)觀測(cè)人員的使用習(xí)慣設(shè)計(jì)了一款基于Win32平臺(tái)的應(yīng)用程序,主要用于顯示電機(jī)當(dāng)前位置以及發(fā)送各類控制指令。經(jīng)試驗(yàn)結(jié)果表明,本論文所設(shè)計(jì)的控制系統(tǒng)基本滿足濾光器波帶控制系統(tǒng)的性能要求,其中所涉及的方法和成果對(duì)于步進(jìn)電機(jī)控制等相關(guān)工程應(yīng)用具有一定的通用性。
【關(guān)鍵詞】:濾光器 NIOSII FPGA FRAM 步進(jìn)電機(jī)控制
【學(xué)位授予單位】:北京交通大學(xué)
【學(xué)位級(jí)別】:碩士
【學(xué)位授予年份】:2016
【分類號(hào)】:TH753.1
【目錄】:
  • 致謝5-6
  • 摘要6-7
  • ABSTRACT7-11
  • 1 緒論11-14
  • 1.1 研究背景11-12
  • 1.2 研究現(xiàn)狀12-13
  • 1.3 研究?jī)?nèi)容及論文結(jié)構(gòu)13-14
  • 2 研究基礎(chǔ)14-21
  • 2.1 步進(jìn)電機(jī)技術(shù)簡(jiǎn)述14-15
  • 2.2 FPGA概念簡(jiǎn)述15-16
  • 2.3 SOPC及NIOSⅡ技術(shù)介紹16-19
  • 2.3.1 何謂SOPC16-17
  • 2.3.2 NIOSⅡ處理器17-18
  • 2.3.3 Avalon總線18-19
  • 2.4 基于NIOSⅡ的SOPC系統(tǒng)開發(fā)流程19-20
  • 2.5 本章小結(jié)20-21
  • 3 系統(tǒng)硬件平臺(tái)設(shè)計(jì)與實(shí)現(xiàn)21-45
  • 3.1 硬件總體架構(gòu)設(shè)計(jì)21-22
  • 3.2 處理器及核心板選型22-23
  • 3.3 通信方案選擇及電路設(shè)計(jì)23-25
  • 3.3.1 通信方案分析及選擇23-24
  • 3.3.2 電路設(shè)計(jì)24-25
  • 3.3.3 通信電路功能驗(yàn)證25
  • 3.4 存儲(chǔ)模塊方案設(shè)計(jì)25-28
  • 3.4.1 外掛Flash芯片25-26
  • 3.4.2 外掛EEPROM芯片26-27
  • 3.4.3 基于FRAM芯片的存儲(chǔ)系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)27-28
  • 3.4.4 存儲(chǔ)模塊功能驗(yàn)證28
  • 3.5 電源電路及控制信號(hào)電路設(shè)計(jì)與實(shí)現(xiàn)28-30
  • 3.5.1 底板供電電路29
  • 3.5.2 輸出信號(hào)放大電路及芯片保護(hù)電路29-30
  • 3.5.3 電源及保護(hù)電路模塊功能驗(yàn)證30
  • 3.6 電路設(shè)計(jì)及PCB制作30-34
  • 3.7 FPGA硬件設(shè)計(jì)及IP核配置34-40
  • 3.7.1 硬件配置平臺(tái)——Quartusll34-35
  • 3.7.2 NIOSⅡ處理器添加與配置35-36
  • 3.7.3 SDRAM Controller及EPCS配置36
  • 3.7.4 RS232串口通信核配置36-37
  • 3.7.5 定時(shí)器控制核37
  • 3.7.6 PIO控制核37-38
  • 3.7.7 SPI總線核38
  • 3.7.8 PLL設(shè)置38-39
  • 3.7.9 基址、中斷地址及引腳分配39-40
  • 3.8 關(guān)鍵IP核寄存器結(jié)構(gòu)40-43
  • 3.9 本章小結(jié)43-45
  • 4 濾光器波帶控制系統(tǒng)程序設(shè)計(jì)45-57
  • 4.1 NIOSⅡ程序設(shè)計(jì)45-53
  • 4.1.1 軟件開發(fā)工具——NIOSⅡ IDE45-46
  • 4.1.2 寄存器控制方式46-47
  • 4.1.3 NIOSⅡ驅(qū)動(dòng)程序及控制程序設(shè)計(jì)47-53
  • 4.2 上位機(jī)程序設(shè)計(jì)53-56
  • 4.2.1 用戶界面設(shè)計(jì)53-54
  • 4.2.2 控件行為程序設(shè)計(jì)54-56
  • 4.3 本章小結(jié)56-57
  • 5 系統(tǒng)功能驗(yàn)證及裝箱測(cè)試57-60
  • 5.1 控制系統(tǒng)整體驗(yàn)證57-58
  • 5.1.1 NIOSⅡ配置信息及軟件固化57
  • 5.1.2 整體功能驗(yàn)證57-58
  • 5.2 控制箱裝配58-60
  • 6 總結(jié)與展望60-61
  • 參考文獻(xiàn)61-63
  • 作者簡(jiǎn)歷及攻讀碩士/博士學(xué)位期間取得的研究成果63-65
  • 學(xué)位論文數(shù)據(jù)集65

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本文編號(hào):965250

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