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基于FPGA多功能數(shù)字鐘的設計

發(fā)布時間:2021-02-11 21:17
  <正>人類社會步入高速發(fā)展的電子時代,電子產品逐漸代替機械產品走入我們的生活。隨著科技的進步人們對電子產品的要求越來越高、傳統(tǒng)產品已經不能滿足人們的需求。體積小、多功能、節(jié)能、環(huán)保開始成為了電子產品發(fā)展的新目標。本文基于VHDL語言,利用QuartusⅡ設計了一款多功能數(shù)字鐘,內部包含秒表、鬧鐘、定時器、時鐘四個模塊。經過實驗仿真表明多功能數(shù)字鐘能很好地滿足生活中的各種需要。本產品設計主要使用VHDL語言描述了各個模塊的功能來實現(xiàn)主要電路,最后在Quartus II上完成了調試與仿真。VHDL語言實現(xiàn)電子設計,是一個以軟件設計為主,器件配置相結合的過程,能從多個層次對數(shù)字系統(tǒng)進行設計,設計數(shù)字電路更為靈活方便,設計周期也可大大減小,提高了設計效率和可靠性。 

【文章來源】:電子世界. 2020,(17)

【文章頁數(shù)】:2 頁

【部分圖文】:

基于FPGA多功能數(shù)字鐘的設計


仿真結果二

系統(tǒng)整體,電路,多功能,數(shù)字


如圖1所示,多功能數(shù)字鐘大致可以劃分為五個部分,分別為顯示電路部分,時鐘部分,鬧鐘部分,定時器部分,秒表部分。后四個部分各自有自己完整的結構,各工作各的,最后一起輸送到顯示電路部分,有外部信號控制顯示電路從而選擇其中一個部分作為輸出顯示。我們通過控制顯示電路的顯示來讓這個多功能數(shù)字鐘作為不同的工具使用。2 硬件部分

功能圖,時鐘,功能,模塊


時鐘設計有三個要求第一,具有時、分、秒計數(shù)顯示的功能,并以24h循環(huán)計時。第二,走時誤差小于等于每天10s。第三,具有調節(jié)分鐘、小時、秒以及清零的功能。通常情況不需要讓時鐘停止工作,所以這部分模塊就相當于實現(xiàn)了計數(shù)功能,對一直不斷給入的1HZ脈沖進行計數(shù)。秒、分、時分了三個模塊進行連接。qw是個過渡模塊,也是校正時間所用的模塊。校正時有兩個開關,一個校正分、一個校正時。如圖2所示,qw模塊主要是為了實現(xiàn)調時功能。實際工程中做了元件例化。元件例化的主要作用是在大型項目的設計中許多底層文件需要反復使用,我們寫好底層文件之后通過component語句可以直接對底層文件進行調用方便了項目的設計。


本文編號:3029720

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