【摘要】：PLC內部設置有眾多的定時器,通常在工程應用中只使用了部分定時器。因此應用ARM-FPGA架構的PLC系統(tǒng),設計FPGA定時器控制器的體系結構,1 ms作為基本定時單位,采用地址映射存儲器順序存儲被PLC用戶程序使用了的定時器的編號,只對被使用的定時器進行定時操作,提高了PLC的定時計數(shù)處理速度。闡述了定時器控制器的各功能模塊的工作原理,以及與FPGA中央控制器的通信方式和通信的指令命令。經(jīng)過仿真與測試,定時誤差不大于0.1 ms,減少了PLC定時器執(zhí)行定時操作的時間,達到精確定時的目的。
[Abstract]:PLC has many internal timers, usually only partial timers are used in engineering applications. Therefore, the PLC system based on ARM-FPGA architecture is used to design the architecture of FPGA timer controller, which is used as the basic timing unit. The address mapping memory is used to store the serial number of the timer used by the PLC user program. The timing operation of the used timer only improves the processing speed of the PLC timing count. The working principle of each function module of timer controller and the communication mode and command of communication with FPGA central controller are described. After simulation and test, the timing error is less than 0. 1 ms, which reduces the time of timing operation of PLC timer and achieves the purpose of accurate timing.
【作者單位】： 廣西科技大學電氣與信息工程學院;
【基金】：廣西科學基金項目(2014GXNSFAA118392) 廣西教育廳科研項目(2013LX092)
【分類號】：TH714.8

【參考文獻】

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【共引文獻】

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