本文關(guān)鍵詞：基于FPGA的視頻數(shù)據(jù)轉(zhuǎn)發(fā)系統(tǒng)設(shè)計

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【摘要】：在數(shù)字化和現(xiàn)代視頻理念的高速發(fā)展過程中,液晶電視技術(shù)和顯示技術(shù)可以輕松地把收集到的信息帶到我們面前,方便我們做出決策并對其進行研究。生活中,我們需要欣賞進口的錄像節(jié)目、衛(wèi)星電視節(jié)目,由于其技術(shù)標(biāo)準(zhǔn)與我國的PAL/D不可能完全相同,因此我們需要通過制式轉(zhuǎn)換使我們的電視機和要看的電視節(jié)目相互兼容,制式相通。而在生產(chǎn)研究中,由于各方面標(biāo)準(zhǔn)和需求不同,往往需要對同一種視頻數(shù)據(jù)根據(jù)不同的需要在不同制式的顯示器上進行顯示,而不同制式的顯示器對幀頻、像素、亮度帶寬、色度帶寬等有不同的要求,對工作的進行有較大的影響。有鑒于此,本課題設(shè)計了一塊以FPGA作為主控芯片開發(fā)平臺的目標(biāo)信息處理板,它是一個獨立的電路模塊,能有效解決上述問題。FPGA具有用戶可編程、可靠性高、集成度高等優(yōu)點,在芯片中即可設(shè)計板級電路,使得印刷電路板的制作難度大大降低,同時改善了設(shè)計的靈活性與效率。再加上其時鐘頻率高、內(nèi)部延遲小等優(yōu)點,FPGA被廣泛適用于國防、通訊、電子等領(lǐng)域。使用FPGA對本系統(tǒng)進行開發(fā)時,在完成模塊接口設(shè)計的前提下,利用硬件描述語言VHDL來描述設(shè)計思想,然后利用Modelsim工具進行仿真,最后利用Xilinx的FPGA實現(xiàn)其功能。此信息處理板在具有PAL制視頻輸出功能的同時,也具有DVI視頻輸出功能。通過攝像機捕捉的分辨率為640x512(100Hz,單色8bits)的LVDS輸入圖像,分兩路輸出,DVI輸出640x480pixel(75Hz,8bits)的圖像,PAL輸出640x512pixel(25Hz)的圖像。在對輸入的紅外數(shù)字視頻信號進行信息處理之余,還可以與上位機和外部進行通訊,更具有復(fù)位功能、固化程序等功能。
【關(guān)鍵詞】：顯示技術(shù) FPGA 制式轉(zhuǎn)換 PAL DVI
【學(xué)位授予單位】：中國地質(zhì)大學(xué)(北京)
【學(xué)位級別】：碩士
【學(xué)位授予年份】：2015
【分類號】：TN791;TN941
【目錄】：

• 摘要5-6
• Abstract6-9
• 第1章 緒論9-15
• 1.1 研究背景9-10
• 1.2 研究目的及意義10-13
• 1.3 本文的主要內(nèi)容與架構(gòu)安排13-15
• 第2章 FPGA設(shè)計方法及開發(fā)工具15-25
• 2.1 FPGA簡介15-16
• 2.1.1 FPGA的發(fā)展15
• 2.1.2 FPGA/CPLD工作原理15-16
• 2.1.3 FPGA典型應(yīng)用領(lǐng)域16
• 2.2 FPGA的設(shè)計流程16-18
• 2.3 FPGA編程工藝18
• 2.4 開發(fā)環(huán)境18-20
• 2.4.1 開發(fā)軟件ISE14.418-19
• 2.4.2 開發(fā)軟件Quartus II19
• 2.4.3 功能仿真軟件Modelsim19-20
• 2.5 硬件描述語言20-22
• 2.5.1 1VHDL描述語言20-21
• 2.5.2 Verilog描述語言21
• 2.5.3 采用VHDL進行設(shè)計的優(yōu)點21-22
• 2.6 FPGA設(shè)計的指導(dǎo)思想22-24
• 2.6.1 同步設(shè)計原則22
• 2.6.2 盡量使用全局時鐘22-23
• 2.6.3 面積與速度的平衡和互換原則23
• 2.6.4 系統(tǒng)原則23-24
• 2.7 本章小結(jié)24-25
• 第3章 系統(tǒng)設(shè)計25-66
• 3.1 系統(tǒng)概述25-26
• 3.1.1 系統(tǒng)結(jié)構(gòu)設(shè)計25-26
• 3.1.2 系統(tǒng)功能設(shè)計26
• 3.2 系統(tǒng)外圍電路26-45
• 3.2.1 FPGA芯片26-28
• 3.2.2 PAL芯片28-33
• 3.2.3 DVI芯片33-37
• 3.2.4 LVDS芯片37-39
• 3.2.5 異步SRAM芯片39-42
• 3.2.6 外部存儲芯片42-45
• 3.2.7 其他芯片45
• 3.3 系統(tǒng)模塊設(shè)計45-65
• 3.3.1 LVDS模塊45-49
• 3.3.2 DVI電路模塊49-52
• 3.3.3 PAL電路模塊52-57
• 3.3.4 異步SRAM模塊57-60
• 3.3.5 外部存儲模塊60-65
• 3.4 本章小結(jié)65-66
• 第4章 電路仿真結(jié)果分析66-75
• 4.1 Modelsim 10.1 仿真環(huán)境介紹66-67
• 4.2 數(shù)據(jù)傳輸模塊仿真結(jié)果67-69
• 4.3 分辨率調(diào)整模塊69-70
• 4.4 行場同步仿真結(jié)果70-75
• 第5章 總結(jié)與展望75-76
• 致謝76-77
• 參考文獻77-79
• 個人簡歷79

【參考文獻】

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本文編號：671320