本文關(guān)鍵詞：高階調(diào)制信號(hào)發(fā)生器設(shè)計(jì)與實(shí)現(xiàn)，由筆耕文化傳播整理發(fā)布。

【摘要】：信號(hào)發(fā)生器是通信系統(tǒng)中設(shè)計(jì)、仿真時(shí)需要用到的重要部件,也是通信與通信對(duì)抗系統(tǒng)中研究的基本部件,在通信、雷達(dá)、測(cè)量、控制以及教學(xué)等領(lǐng)域的應(yīng)用十分廣泛。然而,傳統(tǒng)的信號(hào)發(fā)生器存在著輸出頻率低、傳輸速率低、硬件規(guī)模大、不易擴(kuò)展等問題。為了解決這些問題,本文深入研究并做如下工作：1)針對(duì)目前數(shù)字信號(hào)發(fā)生器輸出頻率低、調(diào)制功能有限、不易擴(kuò)展等缺陷,提出一種高階調(diào)制信號(hào)發(fā)生器的解決方案。該方案采用軟件無(wú)線電思想,提高了硬件平臺(tái)的擴(kuò)展性和靈活性；通過DSP處理器,提高數(shù)據(jù)傳輸速率和豐富調(diào)制功能；運(yùn)用上變頻器,保證輸出頻率。2)研究了軟件無(wú)線電思想、數(shù)字調(diào)制理論、上變頻理論、高效數(shù)字濾波理論,由MATLAB進(jìn)行仿真驗(yàn)證,為實(shí)際開發(fā)中基帶信號(hào)處理和上變頻處理提供了必要基礎(chǔ)。3)針對(duì)單DSP系統(tǒng)、單FPGA系統(tǒng)和DSP+FPGA系統(tǒng)各自所存在的缺陷,提出一種基于軟件無(wú)線電思想,以DSP處理器為核心,結(jié)合CPLD和上變頻器的高階調(diào)制信號(hào)發(fā)生器設(shè)計(jì)方案。設(shè)計(jì)了以DSP為核心的基帶信號(hào)處理模塊、以AD9857為核心的上變頻模塊、以CPLD為核心的控制模塊,以此完成高階調(diào)制信號(hào)發(fā)生器的硬件設(shè)計(jì),并對(duì)各個(gè)模塊電路以及模塊間的接口電路進(jìn)行了具體設(shè)計(jì)和分析。4)對(duì)高階調(diào)制信號(hào)發(fā)生器進(jìn)行了軟件設(shè)計(jì),對(duì)基帶信號(hào)處理進(jìn)行程序設(shè)計(jì)和仿真；分析了上變頻芯片AD9857和DSP處理器的串口通信方式,并對(duì)串口程序進(jìn)行了設(shè)計(jì)；研究了AD9857并口通信方式和DSP外部中斷初始化方式,并對(duì)并口程序進(jìn)行了設(shè)計(jì)；對(duì)DSP外部存儲(chǔ)器接口及FLASH讀寫程序進(jìn)行了設(shè)計(jì)。5)搭建了系統(tǒng)測(cè)試平臺(tái),對(duì)CCS3.3軟件的測(cè)試結(jié)果和示波器實(shí)物測(cè)試結(jié)果進(jìn)行了觀測(cè)和對(duì)比分析。測(cè)試結(jié)果表明,本文設(shè)計(jì)的高階調(diào)制信號(hào)發(fā)生器能夠正確地產(chǎn)生64QAM信號(hào)、64ASK信號(hào),并可以根據(jù)實(shí)際需求設(shè)計(jì)所需要的信號(hào),達(dá)到了預(yù)期的設(shè)計(jì)目標(biāo)。
【關(guān)鍵詞】：DSP 高階調(diào)制 軟件無(wú)線電 信號(hào)發(fā)生器
【學(xué)位授予單位】：南京信息工程大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2015
【分類號(hào)】：TN911.3
【目錄】：

• 摘要6-7
• ABSTRACT7-9
• 第1章 緒論9-14
• 1.1 研究目的及意義9-10
• 1.2 國(guó)內(nèi)外研究現(xiàn)狀10-12
• 1.3 本文主要研究?jī)?nèi)容12-14
• 第2章 高階調(diào)制信號(hào)發(fā)生器的理論基礎(chǔ)14-28
• 2.1 軟件無(wú)線電思想14-16
• 2.1.1 軟件無(wú)線的主要特點(diǎn)14-15
• 2.1.2 軟件無(wú)線電關(guān)鍵技術(shù)15-16
• 2.2 數(shù)字調(diào)制原理16-20
• 2.2.1 二進(jìn)制數(shù)字調(diào)制原理16-18
• 2.2.2 正交振幅調(diào)制(QAM)原理18-19
• 2.2.3 IQ調(diào)制原理19-20
• 2.3 數(shù)字上變頻系統(tǒng)20-23
• 2.3.1 數(shù)字上變頻原理20-21
• 2.3.2 整數(shù)倍內(nèi)插21-23
• 2.3.3 采樣率分?jǐn)?shù)倍變換23
• 2.4 高效數(shù)字濾波理論23-27
• 2.4.1 半帶濾波器(HB)24-25
• 2.4.2 積分梳狀濾波器(CIC)25-26
• 2.4.3 數(shù)字混頻正交變換理論26-27
• 2.5 本章小結(jié)27-28
• 第3章 高階調(diào)制信號(hào)發(fā)生器的硬件設(shè)計(jì)28-43
• 3.1 系統(tǒng)整體設(shè)計(jì)方案28-29
• 3.2 基帶信號(hào)處理模塊29-31
• 3.2.1 DSP處理器TM320VC5509A29
• 3.2.2 DSP外圍電路設(shè)計(jì)29-31
• 3.3 上變頻模塊31-35
• 3.3.1 上變頻器AD985731-33
• 3.3.2 串口通信接口設(shè)計(jì)33-34
• 3.3.3 并口通信接口設(shè)計(jì)34
• 3.3.4 AD9857外圍電路設(shè)計(jì)34-35
• 3.4 CPLD控制模塊35-39
• 3.4.1 CPLD和FLASH存儲(chǔ)器35-36
• 3.4.2 按鍵和液晶顯示器接口設(shè)計(jì)36-38
• 3.4.3 FLASH高位地址擴(kuò)展接口設(shè)計(jì)38-39
• 3.5 電路的PCB設(shè)計(jì)39-42
• 3.6 本章小結(jié)42-43
• 第4章 高階調(diào)制信號(hào)發(fā)生器的軟件設(shè)計(jì)43-63
• 4.1 基帶信號(hào)處理43-49
• 4.1.1 偽隨機(jī)碼序列程序設(shè)計(jì)43-45
• 4.1.2 IQ映射程序設(shè)計(jì)45-47
• 4.1.3 根升余弦濾波程序設(shè)計(jì)47-49
• 4.2 串口通信模塊49-55
• 4.2.1 AD9857串口分析49-51
• 4.2.2 多通道緩沖串口(McBSP)初始化51-54
• 4.2.3 串口通信程序設(shè)計(jì)54-55
• 4.3 并口通信模塊55-59
• 4.3.1 AD9857并口分析55-56
• 4.3.2 外部中斷初始化56-57
• 4.3.3 并口通信程序設(shè)計(jì)57-59
• 4.4 FLASH存儲(chǔ)模塊59-62
• 4.4.1 異步存儲(chǔ)器(EMIF)接口初始化59-60
• 4.4.2 數(shù)據(jù)燒寫程序設(shè)計(jì)60-62
• 4.5 本章小結(jié)62-63
• 第5章 測(cè)試平臺(tái)搭建及結(jié)果分析63-71
• 5.1 測(cè)試步驟及結(jié)果分析64-70
• 5.1.1 SPI通信時(shí)序測(cè)試64-65
• 5.1.2 液晶屏菜單顯示65-66
• 5.1.3 單頻正弦信號(hào)測(cè)試66-68
• 5.1.4 64ASK信號(hào)測(cè)試68-69
• 5.1.5 64QAM信號(hào)測(cè)試69-70
• 5.2 本章小結(jié)70-71
• 第6章 總結(jié)與展望71-73
• 參考文獻(xiàn)73-77
• 致謝77-78
• 攻讀碩士學(xué)位期間的科研成果78-79
• 附錄A 電源模塊原理圖79-80
• 附錄B 時(shí)鐘復(fù)位JTAG原理圖80-81
• 附錄C DSP模塊原理圖81-82
• 附錄D FLASH和CPLD模塊原理圖82-84
• 附錄E 上變頻模塊原理圖84-85
• 附錄F 高階調(diào)制信號(hào)發(fā)生器實(shí)物圖85

【參考文獻(xiàn)】

中國(guó)期刊全文數(shù)據(jù)庫(kù) 前10條

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10 韓紅霞;耿愛輝;;DSP外部FLASH燒寫的兩種方法[J];微計(jì)算機(jī)信息;2007年08期

  本文關(guān)鍵詞：高階調(diào)制信號(hào)發(fā)生器設(shè)計(jì)與實(shí)現(xiàn)，，由筆耕文化傳播整理發(fā)布。

本文編號(hào)：391801