寬帶電臺多速率調(diào)制解調(diào)器研發(fā)
【圖文】:
第四章 多速率調(diào)制解調(diào)器實現(xiàn)與測試主要是對多速率調(diào)制解調(diào)器進行系統(tǒng)硬件實現(xiàn)及測試。首先,介該平臺的各芯片進行了簡要說明。然后給出了物理層與控制層的 FPGA 結(jié)合在一起進行數(shù)據(jù)交互。接著對發(fā)送端和接收端涉及調(diào)試波形進行了詳細地分析。最后,給出系統(tǒng)的測試方案,一步了平臺的可靠性,也驗證了數(shù)據(jù)處理算法的性能。平臺與接口設(shè)計 系統(tǒng)開發(fā)平臺統(tǒng)的開發(fā)平臺使用的是 Xilinx 系列的 SoC 器件 ZYNQ-7030 以及發(fā)器 AD9361,開發(fā)平臺如下圖 4. 1 所示。
圖 4. 2 Xilinx ZYNQ-7030 系統(tǒng)結(jié)構(gòu)ZYNQ 器件擁有雙端口的高速存儲模塊,,即 Block BRAMs,簡稱 BRAM都可以根據(jù)實際需求進行配置,包括位寬和數(shù)據(jù)深度。兩個端口互相獨立進行讀寫操作,如下圖 4. 3 所示。其中,時鐘和復(fù)位信號都是 PS 給出,代表輸入信號,向右的箭頭代表輸出信號,傳輸?shù)臄?shù)據(jù)是 32 位的,地址。圖 4. 3 BRAM 配置圖
【學(xué)位授予單位】:西安電子科技大學(xué)
【學(xué)位級別】:碩士
【學(xué)位授予年份】:2018
【分類號】:TN915.05
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本文編號:2710347
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