發(fā)布時(shí)間：2018-08-10 18:12

【摘要】：針對(duì)星載IP交換機(jī)中硬件資源使用受限的情況,設(shè)計(jì)實(shí)現(xiàn)了一種具有8個(gè)優(yōu)先級(jí)、采用指針復(fù)制和變長分組調(diào)度機(jī)制的大容量共享存儲(chǔ)交換結(jié)構(gòu),給出了電路的具體組成、關(guān)鍵調(diào)度算法和工作流程.使用Xilinx V4sx55FPGA實(shí)現(xiàn)了完整的8×8交換結(jié)構(gòu),電路共占用了164K字節(jié)片上存儲(chǔ)器資源和5982個(gè)4輸入查找表,可以滿足三模冗余設(shè)計(jì)要求.在系統(tǒng)工作主頻為100MHz、片外采用SRAM、數(shù)據(jù)位寬為64的情況下,交換結(jié)構(gòu)的峰值吞吐率可以達(dá)到1.6Gbps;片外采用133MHz DDR存儲(chǔ)器、位寬為64時(shí),交換結(jié)構(gòu)的峰值吞吐率可以達(dá)到4.25Gbps;該交換單元進(jìn)行多級(jí)擴(kuò)展后,可以滿足10Gbps以上的系統(tǒng)設(shè)計(jì)需求.
[Abstract]:Aiming at the limited use of hardware resources in spaceborne IP switch, a large capacity shared storage switching structure with 8 priority, pointer replication and variable length packet scheduling mechanism is designed and implemented, and the specific composition of the circuit is given. Key scheduling algorithms and workflow. A complete 8 脳 8 switch structure is implemented by using Xilinx V4sx55FPGA. The circuit occupies 164K byte on-chip memory resources and 5982 input lookup tables, which can meet the design requirements of three-mode redundancy. When the main frequency of the system is 100 MHz, the off-chip SRAM is used and the data bit width is 64, the peak throughput of the switching structure can reach 1.6 Gbps.When the 133MHz DDR memory is used off-chip, the bit width is 64. The peak throughput of the switching structure can reach 4.25Gbps.After the multistage expansion of the switching unit, it can meet the system design requirements above 10Gbps.
【作者單位】： 解放軍理工大學(xué)通信工程學(xué)院;
【分類號(hào)】：TN927.2;TN915.05

【參考文獻(xiàn)】

相關(guān)期刊論文 前4條

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2 徐揚(yáng);唐毅;文振q;劉斌;;針對(duì)高速交換結(jié)構(gòu)的廣義極大匹配調(diào)度算法[J];電子學(xué)報(bào);2007年10期

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【共引文獻(xiàn)】

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相關(guān)碩士學(xué)位論文 前4條

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【二級(jí)參考文獻(xiàn)】

相關(guān)期刊論文 前5條

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4 徐揚(yáng);唐毅;文振q;劉斌;;針對(duì)高速交換結(jié)構(gòu)的廣義極大匹配調(diào)度算法[J];電子學(xué)報(bào);2007年10期

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【相似文獻(xiàn)】

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1 ;摩托羅拉推出可擴(kuò)展型IP交換機(jī)[N];人民郵電;2006年

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本文編號(hào)：2175796