本文選題：DES算法 + Verilog��； 參考：《微電子學(xué)與計算機(jī)》2014年12期

【摘要】：在詳細(xì)分析DES算法設(shè)計原理基礎(chǔ)上,針對DES算法的運算速度和安全性進(jìn)行綜合考量,提出一種高速高安全性的DES算法設(shè)計.將算法執(zhí)行速度提高了四倍,通過運算時鐘隨機(jī)化同步增強(qiáng)了算法的安全屬性.最后通過對DES算法模塊設(shè)計結(jié)果進(jìn)行仿真驗證及綜合,表明此設(shè)計達(dá)到了性能和面積的綜合優(yōu)化,滿足了加密IP應(yīng)用領(lǐng)域?qū)λ俣群桶踩匀找嫣岣叩男枨?
[Abstract]:On the basis of analyzing the design principle of des algorithm in detail and considering the operation speed and security of des algorithm, a high speed and high security des algorithm design is proposed. The execution speed of the algorithm is increased by four times, and the security attribute of the algorithm is enhanced by the randomization of the operation clock. Finally, the simulation results of des algorithm module design are verified and synthesized, which shows that the design achieves the comprehensive optimization of performance and area, and meets the increasing demand for speed and security in the field of encrypted IP applications.
【作者單位】： 中國地質(zhì)大學(xué)(北京)信息工程學(xué)院;大唐微電子技術(shù)有限公司;
【基金】：中國地質(zhì)大學(xué)(北京)基本科研業(yè)務(wù)費專項基金
【分類號】：TN918.4

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【共引文獻(xiàn)】

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本文編號：2102525