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基于FPGA的壓縮感知恢復算法的研究與實現(xiàn)

發(fā)布時間:2018-05-11 14:36

  本文選題:單光子壓縮感知成像 + 現(xiàn)場可編程門陣列。 參考:《中國科學院研究生院(空間科學與應用研究中心)》2015年碩士論文


【摘要】:在當前數(shù)字信息化時代,信息需求量日益增加,給信號的采集、傳輸、存儲以及處理等帶來非常大的挑戰(zhàn)。壓縮感知理論是近年來出現(xiàn)的一種新的采樣理論,充分利用了信號的稀疏特性,能夠以遠低于Nyquist頻率對信號進行采集,并可通過恢復算法精確重構原始信號。該理論有效緩解了高速采樣實現(xiàn)的壓力,減少了傳輸時間和存儲空間,已經引起各領域的廣泛關注。目前,壓縮感知信號恢復算法大多采用計算機軟件方式來完成,但算法計算量大同時又受限于計算機本身性能,存在重構速度慢的問題。由于ASIC和FPGA具有并行度高,計算速度快,效率高,易裁剪等優(yōu)點,非常適合于復雜算法的速度的提高。因此為滿足實時應用的需求,本課題設計了一種基于FPGA的壓縮感知恢復算法的硬件結構。本文將壓縮感知理論用于單光子計數(shù)成像系統(tǒng)中,可解決面陣探測器單位像素靈敏度受限和采樣數(shù)多的問題。但是數(shù)據(jù)恢復端的計算消耗巨大,恢復時間很長。因此,非常迫切地需要提高成像的速度。用這種基于FPGA的壓縮感知恢復算法的硬件結構替代軟件實現(xiàn)恢復算法,可以加速該成像系統(tǒng)的圖像恢復。具體地,該硬件結構基于正交匹配追蹤(OMP)算法,可以分為尋找最匹配原子和解決最小二乘問題兩大部分。首先利用并行的乘累加器查找測量矩陣中最匹配原子,然后基于坐標旋轉數(shù)字計算(CORDIC)方法實現(xiàn)QR分解,通過加入延時單元來改進脈動陣列和調度處理模塊,進而完成最小二乘問題的求解?蓪ο∈瓒葹8、維度為256的信號進行重建,并在此基礎上對256×256的圖像進行按列重構。實驗結果表明,該硬件結構的單列重構時間為0.296ms,相比于PC上的軟件實現(xiàn),提高近18倍。對于256×256圖像的重構,重構時間為69.703ms,提高了近12倍,重構圖像的PSNR只下降0.001d B,說明重構圖像的質量基本不變。并且軟硬件重構信號的均方誤差(MSE)值基本一致。將此硬件結構應用到單光子計數(shù)成像系統(tǒng)中,實驗表明,不僅提高了速度,而且達到了與之前運用軟件恢復相當?shù)男Ч?br/>[Abstract]:This paper presents a new sampling theory based on FPGA , which can solve the problem of limited sensitivity and high sampling rate .

【學位授予單位】:中國科學院研究生院(空間科學與應用研究中心)
【學位級別】:碩士
【學位授予年份】:2015
【分類號】:TN911.73

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本文編號:1874357

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