本文選題：背板 + 均衡器�。� 參考：《電子學(xué)報(bào)》2014年11期

【摘要】：介紹了一種帶有可重構(gòu)的波特率有限沖激響應(yīng)型均衡器的高速背板發(fā)射機(jī)電路.均衡器可以根據(jù)需要設(shè)置為基于脈沖幅度調(diào)制編碼的數(shù)據(jù)中心優(yōu)化型二電平均衡器和四電平均衡器、邊沿優(yōu)化型均衡器和雙二進(jìn)制均衡器,以及兩倍速過采樣均衡器.給出了均衡器設(shè)計(jì)與優(yōu)化的步驟和公式,并利用90nm CMOS工藝制作了測(cè)試芯片.在40in背板上數(shù)據(jù)率為每秒10 Gbps的實(shí)驗(yàn)結(jié)果較好地符合了理論分析和設(shè)計(jì)目標(biāo).當(dāng)電源電壓為1.2V時(shí),發(fā)射機(jī)功耗為70.3m W,能驅(qū)動(dòng)50Ω的背板,輸出電平峰峰值為500m V.
[Abstract]:A high speed backplane transmitter circuit with a reconfigurable baud rate finite impulse response equalizer is introduced. The equalizer can be arranged as data center optimized two-level equalizer and four-level equalizer based on pulse amplitude modulation coding, edge optimized equalizer and double binary equalizer, and two-fold oversampling equalizer. The steps and formulas of equalizer design and optimization are given, and the test chip is made by using 90nm CMOS technology. The experimental results with a data rate of 10 Gbps per second on the 40in backplane are in good agreement with the theoretical analysis and design objectives. When the power supply voltage is 1.2 V, the power consumption of the transmitter is 70.3m W, which can drive 50 惟 backplane, and the peak value of output level is 500 MV.
【作者單位】： 無錫工藝職業(yè)技術(shù)學(xué)院電子信息系;Carleton大學(xué)電子系;
【分類號(hào)】：TN830

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3 王f濤

本文編號(hào)：1845025