本文選題：晶體管參量倍頻 + DDS�。� 參考：《電子科技大學(xué)》2015年碩士論文

【摘要】：現(xiàn)代戰(zhàn)爭(zhēng)是科技的戰(zhàn)爭(zhēng),隨著軍事通信中人為干擾因素越來(lái)越嚴(yán)重,對(duì)通信設(shè)備的抗干擾性能的要求越來(lái)越高。其中,跳頻通信技術(shù)在抗干擾、抗截獲方面有著巨大的優(yōu)越性。跳頻通信系統(tǒng)中,頻綜是其核心部件,頻綜的性能直接影響跳頻系統(tǒng)的抗干擾、抗截獲能力。本論文介紹了跳頻通信系統(tǒng)中核心部件頻綜的各種實(shí)現(xiàn)方法。通過(guò)對(duì)晶體管倍頻、DDS(直接數(shù)字頻率合成)、PLL(鎖相環(huán))基本方法實(shí)現(xiàn)頻率合成器的理論研究,分析各自優(yōu)缺點(diǎn),得出一種倍頻器、DDS、PLL相結(jié)合實(shí)現(xiàn)頻綜的方案;倍頻器輸出作為DDS的參考系統(tǒng)時(shí)鐘,而DDS的輸出又作為PLL的參考頻率,結(jié)合它們的優(yōu)點(diǎn),避開(kāi)它們的缺點(diǎn),從而使頻綜整體性能更好。其中,倍頻器是基于MRF851晶體管的C類參量倍頻器,利用契比雪夫帶通濾波器對(duì)不需要的諧波濾波;倍頻器輸出作為基于AD9910的DDS的參考時(shí)鐘,針對(duì)DDS輸出雜散多的問(wèn)題,設(shè)計(jì)了帶寬只有30KHz的單片晶體濾波器,對(duì)DDS輸出進(jìn)行窄帶濾波;DDS輸出又作為基于HMC704LP4鑒相芯片的PLL的參考頻率,最后實(shí)現(xiàn)頻綜輸出;通過(guò)設(shè)計(jì)頻綜控制程序,將輸出頻率進(jìn)行分段,段內(nèi)跳頻只需改變DDS頻率控制字,使跳頻時(shí)間非常短,段間跳頻需同時(shí)改變DDS和PLL頻率控制字,跳頻時(shí)間稍長(zhǎng)。對(duì)頻綜系統(tǒng)電源及腔體進(jìn)行了電磁兼容設(shè)計(jì),各模塊分腔處理,最終實(shí)現(xiàn)了頻率范圍從1850MHz~3075MHz的頻綜,頻綜相位噪聲低于-100 dBc/Hz@10 KHz,雜散抑制度優(yōu)于-74d Bc,跳頻時(shí)間小于100?s,頻率步進(jìn)為10 KHz。可以看出該頻綜的整體指標(biāo)較好,滿足跳頻系統(tǒng)中對(duì)頻綜的需求。
[Abstract]:Modern war is the war of science and technology. With the more and more serious human interference factors in military communication, the anti-interference performance of communication equipment is becoming more and more high. Among them, frequency-hopping communication technology has great superiority in anti-jamming and anti-interception. In frequency hopping communication system, frequency ensemble is the core component. The performance of frequency synthesizer directly affects the anti-jamming and anti-interception ability of frequency hopping system. This paper introduces a variety of implementation methods of frequency synthesis of core components in frequency hopping communication system. Through the theoretical research on the realization of frequency synthesizer based on DDS (Direct Digital Frequency synthesizer PLL) method, the advantages and disadvantages of the frequency synthesizer are analyzed, and a scheme of frequency synthesizer based on the combination of frequency multiplier and DDS / PLL is obtained. The frequency multiplier output is used as the clock of the DDS reference system, and the DDS output is the reference frequency of the PLL. By combining their advantages and avoiding their disadvantages, the overall performance of the frequency synthesizer is better. The frequency multiplier is a class C parametric frequency multiplier based on MRF851 transistor, which uses Chebyshev band-pass filter to filter the unwanted harmonics, and the frequency multiplier output is used as the reference clock of DDS based on AD9910, aiming at the problem that DDS output has more spurious output. A single-chip crystal filter with bandwidth only 30KHz is designed, and the output of DDS is used as the reference frequency of PLL based on HMC704LP4 phase discriminator. Finally, the frequency synthesizer output is realized, and the frequency synthesizer control program is designed. When the output frequency is segmented, the frequency hopping in the segment only needs to change the DDS frequency control word, so the frequency hopping time is very short, and the DDS and PLL frequency control words need to be changed at the same time between the segments. The frequency hopping time is a little longer. The electromagnetic compatibility design of the power supply and cavity of the frequency synthesizer system is carried out. The frequency range from 1850MHz~3075MHz to frequency synthesizer is realized. The phase noise of the frequency ensemble is lower than -100 dBc/Hz@10 KHz, the spurious suppression degree is better than -74 d Bc, the frequency hopping time is less than 100 kHz, and the frequency step is 10 kHz. It can be seen that the overall index of the frequency synthesizer is better and meets the need of frequency synthesis in the frequency hopping system.
【學(xué)位授予單位】：電子科技大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2015
【分類號(hào)】：TN914.41

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本文編號(hào)：1794454